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各類處理器中的仲裁

FPGA之家 ? 來源:FPGA之家 ? 作者:FPGA之家 ? 2022-06-16 10:07 ? 次閱讀
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1. 仲裁含義

“仲裁”漢字的意思是一個人站在中立的位置來裁定,保證正常的秩序。因此,涉及裁定,肯定存在資源分配的矛盾,本來就一個東西卻有2方甚至多方爭占。在生活中有仲裁,同樣在架構(gòu)中也有仲裁。

而在嵌入式處理器架構(gòu)中,主要涉及運算和數(shù)據(jù)傳輸?shù)拿苄枰俨?,來保證系統(tǒng)的正常運行。因此,可以通過仲裁的角度將各個處理器架構(gòu)做一個串聯(lián),便于我們學習和理解,文中只是本人自己學習處理器架構(gòu)的筆記總結(jié),僅供學習參考。

2. 各類處理器中的仲裁

MCU(微型處理器即單片機

微型控制器的核心是不斷的從存儲器中讀取指令和數(shù)據(jù)送入運算單元運算后將結(jié)果寫入數(shù)據(jù)存儲器或者輸出,在這個過程中就涉及存儲器和讀寫操作的資源的有限,就會涉及到仲裁處理方式,就出現(xiàn)了2種架構(gòu):

1. 馮諾依曼架構(gòu)的分時復(fù)用,分時在一個總線上去訪問同一存儲器來避免沖突矛盾;

2. 哈佛架構(gòu)的并行處理,2路讀寫總線和2個獨立的存儲器,就不存在沖突矛盾。

當然,當有突發(fā)情況出現(xiàn)的時候,MCU必須優(yōu)先處理該突發(fā)情況,這里就涉及到仲裁的另一種處理方式:

3. 這里采用的方式就是我們常說的中斷,可以理解為被突發(fā)需優(yōu)先處理的事打斷,優(yōu)先處理中斷時間,把手頭的事臨時入庫,待中斷時間處理完后接著出庫處理,這里的入庫出庫即入棧出棧。

PC CPU(通用處理器即電腦

PC CPU是針對通用而設(shè)計的處理器,就是我們辦公用的電腦,仲裁的處理方式和MCU類似,只是更加復(fù)雜:

1. 使用了操作系統(tǒng)來處理各個資源的沖突問題;

2. 使用了線程進程的概念來處理資源的沖突問題。

ARMAdvanced RISC Machines)

ARM可理解為是介入MCU和PC間的嵌入式處理器:

1. 比MCU復(fù)雜,一般帶微型操作系統(tǒng)實現(xiàn)仲裁處理;

2. 比PC靈活,可剪裁,仲裁的處理沒有PC的復(fù)雜;

3.在指令集上深耕數(shù)年,使用精簡的指令集,廣泛用于嵌入式行業(yè),可以理解從指令集角度來處理各種操作的矛盾提高效率。

DSP數(shù)字信號處理器)

DSP即數(shù)字信號處理專用處理器,DSP的沖突更多的是數(shù)據(jù)的運算和處理能力,原有的MCU架構(gòu)的仲裁處理方式無法滿足,因此:

1. 增加計算處理能力,有更加豐富的數(shù)學運算IP核,如三角函數(shù)等高等運算;

2. 增加更多的系統(tǒng)總線架構(gòu),來減少指令、數(shù)據(jù)傳輸間的沖突問題。

GPU

GPU起源是用于圖像處理的專用處理器,而圖像的特點就是數(shù)據(jù)量大,計算量大,后面經(jīng)過需求的不斷推動,出現(xiàn)了顯卡,而再一波AI潮流,讓GPU大放異彩,用一句話來概括GPU的話就是:N個計算核心下超位寬存儲單元的處理器。

1. N個計算核心,GPU擁有數(shù)千個可完成復(fù)雜運算的計算核心,可以同時完成數(shù)千個計算;

2. 超位寬,一般處理器的外部存儲器DDR受頻率位寬的影響數(shù)據(jù)傳輸能力有限,那怕有好的仲裁機制也不行,而GPU的DDR位寬是一般處理器的幾十倍,自然數(shù)據(jù)傳輸上強幾十倍。

FPGA

FPGA計算和數(shù)據(jù)傳輸均可定制,但面臨需要仲裁的問題和處理方式同其它類似:

1. 數(shù)據(jù)計算單元并行化,并行處理大量數(shù)據(jù)時,涉及數(shù)據(jù)的加載、暫存和輸出;

2. 多路總線仲裁數(shù)據(jù)的傳輸,AXI4等總線標準的互聯(lián)IP核,實現(xiàn)更大帶寬的數(shù)據(jù)傳輸,內(nèi)部數(shù)據(jù)傳輸受資源的限制,外部受DDR存儲器理論帶寬和DDR仲裁利用率的限制。

3. 總結(jié)

FPGA要實現(xiàn)高性能的定制功能,也就重點在你的仲裁處理能力,常用的有:

堆資源,用好幾片F(xiàn)PGA處理器;

使用優(yōu)質(zhì)的仲裁架構(gòu),讓數(shù)據(jù)傳輸間效率最優(yōu)化。

隨著FPGA成本下降,5G的崛起,它會越來越用于傳統(tǒng)行業(yè),也就不再是高端的代名詞,會更多的用于消費對成本敏感的市場,那時候或許更好的FPGA定制會產(chǎn)生更大的市場競爭力,帶來更大的利潤。

例如:用EDA軟件提高的AXI總線互聯(lián)IP訪問DDR資源大效率低,而用自己編寫的AXI仲裁代碼只用十分之一的資源而帶來接近雙倍的效率,自然在消費成本敏感市場中占主導(dǎo)地位,或許覺得編寫這樣的AXI仲裁的代價太大,但需求和市場的推動讓我已經(jīng)在深度學習中編寫實現(xiàn)了這樣的代碼并封裝為IP。

審核編輯 :李倩

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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原文標題:仲裁角度淺談各類處理器架構(gòu)

文章出處:【微信號:zhuyandz,微信公眾號:FPGA之家】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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