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      提高Xilinx FPGA Flash下載速度

      FPGA技術(shù)實(shí)戰(zhàn) ? 來源：FPGA技術(shù)實(shí)戰(zhàn) ? 2023-02-14 10:15 ? 次閱讀

      最近在編寫完FPGA邏輯，成功生成.bin文件后，發(fā)現(xiàn)將數(shù)據(jù)流文件燒寫到Flash時(shí)間過長(zhǎng)，突然想起可以通過Vivado軟件進(jìn)行設(shè)置，提高燒寫速度。操作如下：

      （1）布局布線完成后，點(diǎn)擊Open Implementation。

      f0c54b82-aa87-11ed-bfe3-dac502259ad0.png

      （2）點(diǎn)擊Tool-----> Edit Device Properties...

      f0d6eb12-aa87-11ed-bfe3-dac502259ad0.png

      （3）General ----->Enable Bitstream Compression ----->TRUE，選擇壓縮數(shù)據(jù)流，提高下載速度。

      f0f20a50-aa87-11ed-bfe3-dac502259ad0.png

      （4）Configuration -------> Configuration Rate(MHz)，可以選擇較大的CCLK時(shí)鐘值。（如果配置I/O PCB布線不佳，較大的時(shí)鐘可能會(huì)導(dǎo)致FLASH燒寫失敗，此時(shí)需要降低CCLK時(shí)鐘）

      f1074960-aa87-11ed-bfe3-dac502259ad0.png

      點(diǎn)擊OK，并點(diǎn)擊“保存”菜單，保存當(dāng)前配置。

      f11f1e6e-aa87-11ed-bfe3-dac502259ad0.png

      打開.xdc約束文件，我們可以看到新增以下內(nèi)容：

      f1347eee-aa87-11ed-bfe3-dac502259ad0.png

      完成以上操作，重新生成bit文件及bin文件即可實(shí)現(xiàn)加快FLASH燒寫速度。

      審核編輯：湯梓紅

      聲明：本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人，不代表電子發(fā)燒友網(wǎng)立場(chǎng)。文章及其配圖僅供工程師學(xué)習(xí)之用，如有內(nèi)容侵權(quán)或者其他違規(guī)問題，請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
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      原文標(biāo)題：提高Xilinx FPGA Flash下載速度

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