核間通信（IPC）的目標(biāo)和實現(xiàn)機制
目前很多芯片都會有幾個core核，有的是CortexM0+、M4、M7、A53、A73等等，有的有著2核、3核、4核甚至6核8核，不同的核的主頻支持度不一樣，適用的具體應(yīng)用場景也不同，因此需要IPC（Inter-processor communication）來核間通信，進行數(shù)據(jù)的交互。
核間通信（IPC）的主要目標(biāo)是：充分利用硬件提供的機制，實現(xiàn)高效的CORE間通信；給需要CORE間通信的應(yīng)用程序提供簡潔高效的編程接口。
根據(jù)所使用的硬件特性，核間通信的實現(xiàn)機制有：
? ·Mailbox中斷
? ·基于共享內(nèi)存的消息隊列
封裝-VRING-解析的過程：1、應(yīng)用程序向給定目的地（CPU、端點）發(fā)送消息
2、消息首先從應(yīng)用程序復(fù)制到兩個CPU之間使用的VRING。此后，IPC驅(qū)動程序在硬件郵箱中發(fā)布 VRING ID。
3、這會觸發(fā)目標(biāo) CPU 上的中斷。在目標(biāo) CPU 的 ISR 中，它提取 VRING ID，然后根據(jù) VRINGID 檢查該 VRING
中的所有消息。
4、如果收到消息，它從VRING中提取消息并將其放入目標(biāo)RPMSG端點隊列中。然后觸發(fā)在此 RPMSG端點上阻止的應(yīng)用程序。
5、應(yīng)用程序處理接收到的消息，并使用相同的RPMSG 和VRING 機制在相反方向回復(fù)發(fā)送方CPU。
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