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ADF4368集成VCO的微波寬帶技術(shù)手冊

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概述
ADF4368 是一款集成 VCO 的高性能、超低抖動、整數(shù) N 分頻和小數(shù) N 分頻鎖相環(huán) (PLL),非常適合頻率轉(zhuǎn)換應(yīng)用。

高性能 PLL 具有 ?239dBc/Hz、超低 ?287dBc/Hz 歸一化 1/f 噪聲和高 PFD 頻率,可實(shí)現(xiàn)超低帶內(nèi)噪聲和集成抖動性能。無需內(nèi)部倍頻器,ADF4368 可生成 800MHz 至 12.8GHz 范圍內(nèi)的任意頻率,因而無需子諧波濾波器。Σ-Δ 調(diào)制器包括支持赫茲頻率分辨率的 25 位固定模數(shù)和額外的 17 位可變模數(shù),該模數(shù)支持更高的分辨率,可實(shí)現(xiàn)靈活的頻率規(guī)劃。該套件在單端配置下具有 9dBm (12.8GHz) 輸出功率和 16 步進(jìn)功率調(diào)整特性,非常適合各種應(yīng)用。

對于相控陣?yán)走_(dá)或大規(guī)模 MIMO 系統(tǒng)等多個(gè)頻率轉(zhuǎn)換應(yīng)用,可通過使用 SYNC 輸入或 EZSync^?^ 對齊多個(gè) ADF4368 的輸出。當(dāng)難以將 SYNC 信號精確分配給所有套件時(shí),將使用 EZSync 方法。對于需要確定性延遲或延遲調(diào)整功能的應(yīng)用,提供分辨率 <1ps 的可編程輸出延遲參考。保證在多個(gè)套件和溫度范圍內(nèi)參考輸出延遲,從而實(shí)現(xiàn)可預(yù)測和精確的多芯片對齊。

在整數(shù)和小數(shù)模式下,簡單的 ADF4368 結(jié)構(gòu)框圖通過簡化的串行外圍接口 (SPI) 寄存器映射、外部 SYNC 輸入和可重復(fù)多芯片相位對齊功能,縮短了開發(fā)時(shí)間。
數(shù)據(jù)表:*附件:ADF4368集成VCO的微波寬帶頻率合成器技術(shù)手冊.pdf

應(yīng)用

  • 無線基礎(chǔ)設(shè)施(MC-GSM、5G
  • 測試和測量
  • 航空航天和防務(wù)

特性

  • 輸出頻率范圍:800MHz 至 12.8GHz
  • 抖動 < 30 fsRMS fOUT = 9.001GHz、fREF = fPFD = 250MHz,小數(shù)模式
  • 寬帶本底噪聲:12.8GHz 時(shí)為 ?160dBc/Hz
  • PLL 規(guī)格
    • 歸一化帶內(nèi)相位本底噪聲
      • ?239dBc/Hz:整數(shù),?237dBc/Hz:小數(shù)模數(shù)
    • 歸一化 1/f 相位噪聲:
      • ?287dBc/Hz:歸一化為 1Hz
      • ?147dBc/Hz:10kHz 時(shí)歸一化為 1GHz
    • 625MHz 鑒相器頻率整數(shù)模式
    • 250MHz 鑒相器頻率小數(shù)模式
    • 25 位固定/49 位組合小數(shù)模數(shù)
    • 4GHz 基準(zhǔn)輸入頻率
    • 典型 ?95dBc PFD 雜散
  • 基準(zhǔn)輸出延遲規(guī)格
    • 溫度系數(shù):0.06 ps/°C
    • 調(diào)整步長:<1ps
  • 多芯片輸出相位對齊
    • 通過 SYNC 引腳或 EZSync 方法
  • 3.3V 和 5V 電源
  • 支持 ADIsimPLL^?^ 環(huán)路濾波器設(shè)計(jì)工具
  • 采用 48 引腳 7mm × 7mm LGA 封裝
  • 工作結(jié)溫范圍:?40°C 至 +125°C

框圖
image.png

時(shí)序圖
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引腳配置描述
image.png

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典型性能特征
image.png

應(yīng)用信息

環(huán)路濾波器設(shè)計(jì)

穩(wěn)定的環(huán)路濾波器設(shè)計(jì)需要精心選擇ADF4368的環(huán)路濾波器組件。建議下載并安裝適用于環(huán)路濾波器設(shè)計(jì)和仿真的ADIsimPLL? 。它為首次使用者提供了綜合教程,還有一個(gè)幫助手冊,用于更復(fù)雜的主題。此外,還有多個(gè)ADIsimPLL培訓(xùn)視頻可在www.analog.com觀看。由于環(huán)路濾波器是經(jīng)過設(shè)計(jì)和仿真的,建議使用ADF4368評估硬件來驗(yàn)證新的環(huán)路濾波器。

完整的環(huán)路濾波器設(shè)計(jì)教程超出了本數(shù)據(jù)手冊的范圍。不過,以下列出了一些最佳實(shí)踐,在仿真這些參數(shù)時(shí)會顯示出來。對這些項(xiàng)目的任何重大更改都需要重新設(shè)計(jì)環(huán)路濾波器。

一個(gè)穩(wěn)定的環(huán)路濾波器必須滿足以下標(biāo)準(zhǔn):

  • 環(huán)路濾波器相位裕度 > 45°
  • 環(huán)路濾波器帶寬 < f_{PFD} / 10

所需的環(huán)路濾波器帶寬由ADF4368的以下特性決定:

  • f_{CP}
  • K_{VCO}
  • PFD頻率
  • 參考輸入相位噪聲(見“參考相位噪聲”部分)
  • 在最小化抖動或建立時(shí)間之間進(jìn)行權(quán)衡(分別見“輸出相位噪聲特性”部分和公式12)

VTUNE引腳內(nèi)部有一個(gè)30pF的接地電容,在環(huán)路濾波器設(shè)計(jì)中必須考慮這一因素。ADIsimPLL? 會自動考慮這個(gè)內(nèi)部電容。

參考源考量

參考輸入網(wǎng)絡(luò)

圖34所示的ADF4368參考輸入緩沖器為差分或單端頻率源提供了靈活的接口。圖43至圖48展示了不同參考信號類型的推薦接口。所有Z_0信號跡線均為50Ω傳輸線,如圖43、圖44、圖45、圖46、圖47和圖48所示。
image.png

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聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報(bào)投訴
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