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原理圖PCB設(shè)計(jì)時(shí)認(rèn)真看官網(wǎng)Checklist

DuaO_fpga234 ? 來(lái)源:fqj ? 2019-05-09 08:46 ? 次閱讀
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做項(xiàng)目過(guò)程中,器件選型確定后開(kāi)始原理圖PCB設(shè)計(jì),這其中就包括FPGA的原理圖PCB設(shè)計(jì),而最終制版會(huì)錯(cuò)大多是因?yàn)樵韴D設(shè)計(jì)時(shí)的低級(jí)失誤造成(之前就有項(xiàng)目遇到過(guò)FALSH配置專(zhuān)用引腳隨意分配導(dǎo)致無(wú)法正常從FLASH中加載程序),特別是剛開(kāi)始接觸一個(gè)新的FPGA平臺(tái)時(shí),第一次打板常會(huì)出現(xiàn)一些問(wèn)題(飛線、配置失敗等),多人仔細(xì)檢查會(huì)大概率一次打板成功。

原理圖PCB設(shè)計(jì)時(shí)認(rèn)真看官網(wǎng)Checklist

一般我們?cè)诠倬W(wǎng)可以下載對(duì)應(yīng)的數(shù)據(jù)手冊(cè),然后根據(jù)數(shù)據(jù)手冊(cè)設(shè)計(jì)檢查原理圖PCB:電源、配置、LVDS等,設(shè)計(jì)完成后自己和同事檢查錯(cuò)誤,一不小心就會(huì)出錯(cuò),而且大多是低級(jí)錯(cuò)誤和失誤。

其實(shí),可以通過(guò)FPGA官網(wǎng)都對(duì)應(yīng)的Checklist來(lái)設(shè)計(jì)及檢查,這樣可以大大減少錯(cuò)誤和失誤,Xilinx有類(lèi)似XPE(FPGA(Altera/Xilinx/Actel)如何估算分析功耗)的EXCEL形式的Checklist,下面舉例Xilinx 7series FPGAs的Checklist操作:

Step1:點(diǎn)擊新建一個(gè)Checklist

原理圖PCB設(shè)計(jì)時(shí)認(rèn)真看官網(wǎng)Checklist

Step2:輸入對(duì)應(yīng)的FPGA型號(hào)等參數(shù),輸入完成后就可Check電源部分

原理圖PCB設(shè)計(jì)時(shí)認(rèn)真看官網(wǎng)Checklist

Step3:Check配置部分

原理圖PCB設(shè)計(jì)時(shí)認(rèn)真看官網(wǎng)Checklist

Step4:Check XADC模擬部分

原理圖PCB設(shè)計(jì)時(shí)認(rèn)真看官網(wǎng)Checklist

Step5:Check MGT高速接口部分

原理圖PCB設(shè)計(jì)時(shí)認(rèn)真看官網(wǎng)Checklist

Step6:Check 其它部分,包括時(shí)鐘、MIG等

原理圖PCB設(shè)計(jì)時(shí)認(rèn)真看官網(wǎng)Checklist

注意:1. 原理圖PCB設(shè)計(jì)完成后需要再仔細(xì)Checklist下,因?yàn)镻CB設(shè)計(jì)時(shí)經(jīng)常由于布線等原因可能會(huì)重新隨意分配了專(zhuān)用引腳(配置引腳、JTAG、時(shí)鐘、差分對(duì)等);2. 原理圖有checklist,其它設(shè)計(jì)也會(huì)有,多去官網(wǎng)看看。

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原文標(biāo)題:設(shè)計(jì)時(shí)認(rèn)真看官網(wǎng)Checklist

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