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鋯石FPGA A4_Nano開發(fā)板視頻:FIFO IP核的使用講解

電子硬件DIY視頻 ? 來源:電子硬件DIY視頻 ? 2019-09-27 07:07 ? 次閱讀

FIFO是隊(duì)列機(jī)制中最簡單的,每個接口上都存在FIFO隊(duì)列,表面上看FIFO隊(duì)列并沒有提供什么QoS(Quality of Service,服務(wù)質(zhì)量)保證,甚至很多人認(rèn)為FIFO嚴(yán)格意義上不算做一種隊(duì)列技術(shù)。實(shí)則不然,F(xiàn)IFO是其它隊(duì)列的基礎(chǔ),F(xiàn)IFO也會影響到衡量QoS的關(guān)鍵指標(biāo):報文的丟棄、延時、抖動。既然只有一個隊(duì)列,自然不需要考慮如何對報文進(jìn)行復(fù)雜的流量分類,也不用考慮下一個報文怎么拿、拿多少的問題,而且因?yàn)榘错樞蛉笪?,F(xiàn)IFO無需對報文重新排序。簡化了這些實(shí)現(xiàn)其實(shí)也就提高了對報文時延的保證。

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    的頭像 發(fā)表于 09-26 07:05 ?1946次閱讀
    <b class='flag-5'>鋯</b><b class='flag-5'>石</b><b class='flag-5'>FPGA</b> <b class='flag-5'>A4_Nano</b><b class='flag-5'>開發(fā)板</b><b class='flag-5'>視頻</b>:內(nèi)置<b class='flag-5'>IP</b><b class='flag-5'>核</b>之Interval Timer的應(yīng)用實(shí)戰(zhàn)<b class='flag-5'>講解</b>