異步復(fù)位優(yōu)點:
a、大多數(shù)目標器件庫的dff都有異步復(fù)位端口,因此采用異步復(fù)位可以節(jié)省資源。
b、設(shè)計相對簡單。
c、異步復(fù)位信號識別方便,而且可以很方便的使用FPGA的全局復(fù)位端口GSR。
缺點:
a、在復(fù)位信號釋放(release)的時候容易出現(xiàn)問題。具體就是說:倘若復(fù)位釋放時恰恰在時鐘有效沿附近,就很容易使寄存器輸出出現(xiàn)亞穩(wěn)態(tài),從而導(dǎo)致亞穩(wěn)態(tài)。
b、復(fù)位信號容易受到毛刺的影響。
-
FPGA
+關(guān)注
關(guān)注
1645文章
22050瀏覽量
618537 -
寄存器
+關(guān)注
關(guān)注
31文章
5434瀏覽量
124513 -
復(fù)位
+關(guān)注
關(guān)注
0文章
179瀏覽量
24671
發(fā)布評論請先 登錄
FPGA的IO口時序約束分析

#英特爾FPGA應(yīng)用 如何修復(fù)與異步復(fù)位相關(guān)的恢復(fù)時序混亂問題- 第一部分

#英特爾FPGA應(yīng)用 如何修復(fù)與異步復(fù)位相關(guān)的恢復(fù)時序混亂問題- 第二部分
FPGA如何避免代碼混亂
FPGA設(shè)計:時序是關(guān)鍵
用FPGA模擬VGA時序PS_2總線的鍵盤接口VHDL源代碼
FPGA中的時序約束設(shè)計

基于FPGA時序優(yōu)化設(shè)計
FPGA如何修復(fù)時序混亂問題(1)
正點原子FPGA靜態(tài)時序分析與時序約束教程

評論