BJ-EPM240學(xué)習(xí)板：Johnson計(jì)數(shù)器實(shí)驗(yàn)
在數(shù)字電子技術(shù)中應(yīng)用的最多的時(shí)序邏輯電路。計(jì)數(shù)器不僅能用于對(duì)時(shí)鐘脈沖計(jì)數(shù)，還可以用于分頻、定時(shí)、產(chǎn)生節(jié)拍脈沖和脈沖序列以及進(jìn)行數(shù)字運(yùn)算等。但是并無(wú)法顯示計(jì)算結(jié)果，一般都是要通過(guò)外接LCD或LED屏才能顯示。
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FPGA視頻教程之BJ-EPM240學(xué)習(xí)板Johnson計(jì)數(shù)器實(shí)驗(yàn)的詳細(xì)資料說(shuō)明
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主芯片使用的是Altera公司的MAXII系列EPM240T100C5，該芯片有240個(gè)邏輯單元，等效宏單元192個(gè)，資源比較豐富，內(nèi)有8KbitFlash的存儲(chǔ)空間。
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這個(gè)實(shí)驗(yàn)可以說(shuō)是verilog入門(mén)最基礎(chǔ)的實(shí)驗(yàn)了，我們不做太多的理論分析，實(shí)踐是硬道理。蜂鳴器與CPLD的接口如圖所示，當(dāng)CPLD的1/0口（FM） 為低電平時(shí)，三極管截至，蜂鳴器不發(fā)聲;當(dāng)CPLD的I/0 （FM）為高電平時(shí)，三極管導(dǎo)通，蜂鳴器發(fā)聲。
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Johnson算法主要用于求稀疏圖上的全源最短路徑，其主體思想是利用重賦權(quán)值的方法把一個(gè)愿問(wèn)題帶負(fù)權(quán)的圖轉(zhuǎn)化為權(quán)值非負(fù)的圖，然后再利用NN次DijkstraDijkstra求出全源最短路徑
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計(jì)數(shù)器就是實(shí)現(xiàn)這種運(yùn)算的邏輯電路，計(jì)數(shù)器在數(shù)字系統(tǒng)中主要是對(duì)脈沖的個(gè)數(shù)進(jìn)行計(jì)數(shù)，以實(shí)現(xiàn)測(cè)量、計(jì)數(shù)和控制的功能，同時(shí)兼有分頻功能，計(jì)數(shù)器是由基
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