| DSP | 1 C64x |
| DSP MHz (Max) | 1000 |
| CPU | 32-/64-bit |
| Operating system | DSP/BIOS |
| Ethernet MAC | 10/100/1000 |
| Rating | HiRel Enhanced Product |
| Operating temperature range (C) | -55 to 100 |
TMS320C64x+? DSP（包括 SM320C6457-HIREL 器件）是 TMS320C6000DSP 平臺上的高性能定點 DSP 系列產品。SM320C6457-HIREL 器件基于德州儀器 (TI) 開發(fā)的第 3 代高性能、高級 VelociTI超長指令字 (VLIW) 架構，這使得該系列 DSP 非常適合 包括 視頻和電信基礎設施、成像/醫(yī)療以及無線基礎設施 (WI) 在內的各類應用。C64x+ 器件向上代碼兼容屬于 C6000? DSP 平臺的早期器件。
基于 65nm 的工藝技術以及憑借高達 96 億條指令每秒 (MIPS) [或 9600 16 位 MMAC 每周期] 的性能（1.2GHz 時鐘速率時），SM320C6457-HIREL 器件提供了一套應對高性能 DSP 編程挑戰(zhàn)的經濟高效型解決方案。SM320C6457-HIREL DSP 可以靈活地利用高速控制器以及陣列處理器的數值計算能力。
C64x+ DSP 內核采用 8 個功能單元、2 個寄存器文件以及 2 個數據路徑。與早期 C6000 器件一樣，其中 2 個功能單元為乘法器或 .M 單元。C64x 內核每個時鐘周期執(zhí)行 4 次 16 位 × 16 位乘法累加，相比之下，C64x+ .M 單元的乘法吞吐量可增加一倍。因此，C64x+ 內核每個周期可以執(zhí)行 8 次 16 位 × 16 位 MAC。采用 1.2GHz 時鐘速率時，這意味著每秒可以執(zhí)行 9600次 16 位 MMAC。此外，C64x+ 內核上的每個乘法器每個時鐘周期可以計算 1 次 32 位 × 32 位 MAC 或 4 次 8 位 × 8 位 MAC。
SM320C6457-HIREL 器件含有串行 RapidIO?。該高帶寬外設可為板上包含多個 DSP 的 應用 （例如，視頻和電信基礎設施以及醫(yī)療/成像）顯著提升系統(tǒng)性能并降低系統(tǒng)成本。
SM320C6457-HIREL DSP 集成有大量的片上存儲器，構成一個第 2 級存儲器系統(tǒng)。SM320C6457-HIREL 器件上的 1 級 (L1) 程序存儲器和數據存儲器的大小均為 32KB。該存儲器可以配置為映射 RAM、緩存或二者的某種組合。當配置為緩存時，L1 程序存儲器 (L1P) 是一個直接映射緩存，而 L1 數據存儲器 (L1D) 是一個 2 路組相連緩存。2 級 (L2) 存儲器由程序空間和數據空間共享，大小為 2048KB。L2 存儲器也可以配置為映射 RAM、緩存或二者的某種組合。L2 可配置為高達 1MB 的緩存。此外，C64x+ 超級模塊還具有 32 位外設配置 (CFG) 端口、內部 DMA (IDMA) 控制器、具有復位/啟動控制的系統(tǒng)組件、中斷/異常控制、掉電控制以及用于時間戳的自由運行 32 位定時器。
外設集包括：1 個內部集成電路總線模塊 (I2C)；2 個多通道緩沖串行端口 (McBSP)；1 個用于異步傳輸模式 (ATM) 從 [UTOPIA 從器件] 端口的 8 位通用測試和運行 PHY 接口；2 個 64 位通用定時器（也可配置為 4 個 32 位定時器）；1 個用戶可配置的 16 位或 32 位主機端口接口 (HPI16/HPI32)；1 個支持可編程中斷/事件生成模式的 16 引腳通用輸入/輸出端口 (GPIO)；1 個 10/100/1000 以太網介質訪問控制器 (EMAC)（可在 SM320C6457-HIREL DSP 內核處理器和網絡之間提供一個高效接口）；1 個管理數據輸入/輸出 (MDIO) 模塊（也屬于 EMAC，可以連續(xù)輪詢全部 32 個 MDIO 地址以枚舉系統(tǒng)內的所有 PHY 器件）；1 個可連接同步和異步外設的無縫外部存儲器接口（64 位 EMIFA）；以及 1 個 32 位 DDR2 SDRAM 接口。
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SM320C6457-HIREL 器件具有 3 個高性能嵌入式協處理器 [1 個增強型維特比解碼器協處理器 (VCP2) 和 2 個增強型 Turbo 解碼器協處理器（TCP2_A 和 TCP2_B）]，可以顯著加速片上的通道解碼操作。VCP2 的運行速度為 CPU 時鐘的三分之一，可以解碼超過 694 個 7.95Kbps 自適應多速率 (AMR) [K = 9，R = 1/3] 語音通道。VCP2 支持約束長度 K= 5、6、7、8 和 9，比率 R = 3/4、1/2、1/3、1/4 和 1/5 以及靈活的多項式，同時能夠生成硬決策或軟決策。每個運行速度為 CPU 時鐘三分之一的 TCP2 可以解碼多達 50 個 384Kbps 或 8 個 2Mbps Turbo 編碼通道（假設 6 次迭代）。TCP2 實現 max*log-map 算法，旨在支持第三代合作項目（3GPP 和 3GPP2）所需的全部多項式和比率，且支持完全可編程的幀長和 Turbo 交錯。解碼參數，例如迭代次數以及停止標準，也都可編程。VCP2/TCP2 與 CPU 之間通過 EDMA3 控制器進行通信。
SM320C6457-HIREL 器件配有一套完整的開發(fā)工具，其中包括：新款 C 編譯器、用于簡化編程和調度過程的匯編優(yōu)化器以及用于查看源代碼執(zhí)行的 Windows調試器接口。
