描述
ADRV9026 是一款高度集成的射頻 (RF) 捷變收發(fā)器，提供四個(gè)獨(dú)立控制的發(fā)射器、用于監(jiān)測(cè)每個(gè)發(fā)射器通道的專用觀測(cè)接收器輸入、四個(gè)獨(dú)立控制的接收器、集成式頻率合成器和數(shù)字信號(hào)處理功能，形成了完整的收發(fā)器解決方案。該器件提供了各種蜂窩基礎(chǔ)設(shè)施應(yīng)用所需的性能，例如小型蜂窩基站無(wú)線電、 3G/4G/5G宏系統(tǒng)和大規(guī)模多路輸入/多路輸出 (MIMO) 基站。
接收器子系統(tǒng)包括四個(gè)具有寬動(dòng)態(tài)范圍的獨(dú)立寬帶寬直接變頻接收器。四個(gè)獨(dú)立發(fā)射器使用直接變頻調(diào)制器，可在低功耗下實(shí)現(xiàn)低噪聲運(yùn)行。該器件還包括兩個(gè)寬帶寬分時(shí)觀測(cè)路徑接收器，每個(gè)接收器具有兩路輸入，用于監(jiān)測(cè)發(fā)射器輸出。
完整的收發(fā)器子系統(tǒng)包括自動(dòng)和手動(dòng)衰減控制、直流失調(diào)校正、正交誤差校正 (QEC) 以及數(shù)字濾波功能，因此數(shù)字基帶中不再需要這些功能。它還集成了模數(shù)轉(zhuǎn)換器 (ADC)、數(shù)模轉(zhuǎn)換器 (DAC) 和用于提供各種數(shù)字控制選項(xiàng)的通用輸入/輸出 (GPIO)接口。
為了實(shí)現(xiàn)高的 RF 性能水平，收發(fā)器包括了五個(gè)完全集成的鎖相環(huán) (PLL)。兩個(gè) PLL 為發(fā)射器和接收器信號(hào)路徑提供低噪聲和低功耗小數(shù) N分頻 RF頻率合成。第三個(gè)完全集成的 PLL 支持觀測(cè)接收器的獨(dú)立本振 (LO) 模式。第四個(gè) PLL 可生成轉(zhuǎn)換器和數(shù)字電路所需的時(shí)鐘，第五個(gè) PLL 可為串行數(shù)據(jù)接口提供時(shí)鐘。
多芯片同步機(jī)制可在多個(gè) ADRV9026 芯片之間同步所有 LO相位 和基帶時(shí)鐘。集成了所有壓控振蕩器 (VCO) 和環(huán)路濾波器元件，并可通過(guò)數(shù)字控制接口進(jìn)行調(diào)整。
串行數(shù)據(jù)接口包括四個(gè)串行器通道和四個(gè)解串器通道。該接口支持 JESD204B 和 JESD204C 標(biāo)準(zhǔn)，可在高達(dá) 16 Gbps 的數(shù)據(jù)速率下運(yùn)行。該接口還支持針對(duì)更低帶寬的交錯(cuò)模式，從而將高速數(shù)據(jù)接口通道數(shù)減少至1。支持固定和浮點(diǎn)數(shù)據(jù)格式。浮點(diǎn)格式可使內(nèi)部自動(dòng)增益控制 (AGC) 對(duì)解調(diào)器器件不可見(jiàn)。
ADRV9026 直接由 1.0 V、1.3 V 和 1.8 V 穩(wěn)壓器供電，并通過(guò)標(biāo)準(zhǔn)串行外設(shè)接口 (SPI) 串行端口進(jìn)行控制。該器件包括全面的關(guān)斷模式，以便在正常使用過(guò)程中較大限度地減小功耗。ADRV9026 采用 14 mm × 14 mm、289 引腳芯片級(jí)球柵陣列 (CSP_BGA) 封裝。
特性
? 4 個(gè)差分發(fā)射器
? 4 個(gè)差分接收器
? 2 個(gè)觀察接收器，每個(gè)具有2路輸入
? 中心頻率：75 MHz至6000 MHz
? 最大接收器帶寬：200 MHz
? 最大發(fā)射器大信號(hào)帶寬：200 MHz
? 最大發(fā)射器頻率合成帶寬：450 MHz
? 最大觀測(cè)接收器帶寬：450 MHz
? 完全集成式獨(dú)立小數(shù)N分頻射頻頻率合成器
? 完全集成式時(shí)鐘頻率合成器
? 用于所有本振和基帶時(shí)鐘的多芯片相位同步
? 支持TDD和FDD應(yīng)用
? 24.33 Gbps JESD204B/JESD204C數(shù)字接口
應(yīng)用
? 3G/4G/5G TDD 和 FDD 大規(guī)模 MIMO、宏蜂窩和小型蜂窩基站
相關(guān)型號(hào)器件：
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