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      電子發(fā)燒友網(wǎng)>電子資料下載>單片機(jī)>PIC低功耗設(shè)計(jì)方法

      PIC低功耗設(shè)計(jì)方法

      2017-05-25 | ppt | 754KB | 次下載 | 免費(fèi)

      資料介紹

      PIC低功耗設(shè)計(jì)方法

      　　CMOS電路的功耗來源

      　　影響功耗的因素

      　　低功耗設(shè)計(jì)方法

      　　工藝級(jí)的優(yōu)化技術(shù)

      　　版圖和晶體管級(jí)的優(yōu)化技術(shù)

      　　RTL級(jí)和邏輯級(jí)的優(yōu)化技術(shù)

      　　系統(tǒng)級(jí)的優(yōu)化技術(shù)

      　　采用HDL的低功耗設(shè)計(jì)流程

      　　在數(shù)字CMOS電路中，功耗是由三部分構(gòu)成的

      　　PTotal=Pdynamic+Pshort+ Pleakage

      　　Pdynamic是電路翻轉(zhuǎn)時(shí)產(chǎn)生的動(dòng)態(tài)功耗

      　　Pshort是P管和N管同時(shí)導(dǎo)通時(shí)產(chǎn)生的短路功耗

      　　Pleakage是由擴(kuò)散區(qū)和襯底之間的反向偏置漏電流引起的靜態(tài)功耗
      PIC低功耗設(shè)計(jì)方法

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