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　　主系統(tǒng)由以下部分構(gòu)成：

　　● 四個(gè)驅(qū)動(dòng)單元：

　　? Cortex?-M3 內(nèi)核 ICode 總線（I-bus），DCode 總線（D-bus），和系統(tǒng)總線（S-bus）

　　? GP-DMA（通用 DMA）

　　● 三個(gè)被動(dòng)單元

　　? 內(nèi)部 SRAM

　　? 內(nèi)部閃存存儲(chǔ)器

　　? AHB 到 APB 的橋（AHB2APBx），它連接所有的 APB 設(shè)備

　　這些都是通過一個(gè)多級的AHB總線構(gòu)架相互連接的，如 圖 1 所示：

　　ICode 總線

　　該總線將 Cortex?-M3 內(nèi)核的指令總線與 Flash 指令接口相連接。指令預(yù)取在此總線上完成。

　　DCode 總線

　　該總線將 Cortex?-M3 內(nèi)核的 DCode 總線與閃存存儲(chǔ)器的數(shù)據(jù)接口相連接（常量加載和調(diào)試訪問）。

　　系統(tǒng)總線 系統(tǒng)總線

　　此總線連接 Cortex?-M3 內(nèi)核的系統(tǒng)總線（外設(shè)總線）到總線矩陣，總線矩陣協(xié)調(diào)著內(nèi)核和 DMA 間的訪問。

　　DMA 總線

　　此總線將 DMA 的 AHB 主控接口與總線矩陣相聯(lián)，總線矩陣協(xié)調(diào)著 CPU 的DCode 和 DMA 到 SRAM、閃存和外設(shè)的訪問。

　　總線矩陣 總線矩陣

　　此總線矩陣協(xié)調(diào)內(nèi)核系統(tǒng)總線和 DMA 主控總線之間的訪問仲裁。此仲裁利用輪換算法。此總線矩陣由三個(gè)驅(qū)動(dòng)部件（CPU 的 DCode、系統(tǒng)總線和 DMA 總線）和三個(gè)被動(dòng)部件（閃存存儲(chǔ)器接口、SRAM 和 AHB2APB 橋）構(gòu)成。AHB 外設(shè)通過總線矩陣與系統(tǒng)總線相連，允許 DMA 訪問。

　　AHB/APB 橋（APB）

　　兩個(gè) AHB/APB 橋在 AHB 和 2 個(gè) APB 總線間提供同步連接。APB1 操作速度限于 36MHz，APB2 操作于全速（最高 72MHz）。參考第 1 章有關(guān)連接到每個(gè)橋的不同外設(shè)的地址映射。