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      電子發(fā)燒友網(wǎng)>電子資料下載>IC datasheet pdf>SN65LVDS93,pdf(LVDS Serdes Tra

      SN65LVDS93,pdf(LVDS Serdes Tra

      2010-09-09 | rar | 388 | 次下載 | 5積分

      資料介紹

      The SN65LVDS93 LVDS serdes (serializer/ deserializer) transmitter contains four 7-bit parallel- load serial-out shift registers, a 7× clock synthesizer, and five low-voltage differential signaling (LVDS) drivers in a single integrated circuit. These functions allow 28 bits of single-ended LVTTL data to be synchronously transmitted over five balanced-pair conductors for receipt by a compatible receiver, such as the SN65LVDS94.

      When transmitting, data bits D0 through D27 are each loaded into registers upon the edge of the input clock signal (CLKIN). The rising or falling edge of the clock can be selected via the clock select (CLKSEL) pin. The frequency of CLKIN is multiplied seven times and then used to serially unload the data registers in 7-bit slices.

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