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      電子發(fā)燒友網(wǎng)>電子資料下載>3G技術(shù)資料>3G基站的設(shè)計(jì)、編程和驗(yàn)證原理

      3G基站的設(shè)計(jì)、編程和驗(yàn)證原理

      2010-03-04 | rar | 118 | 次下載 | 10積分

      資料介紹

      今天的3G 系統(tǒng)非常復(fù)雜，要求至少每通道 3,000 MIPS 的速率 — 是 2G 系統(tǒng)的 300 倍 — 寬帶 CDMA 是當(dāng)今業(yè)已推出的最復(fù)雜的 3G 系統(tǒng)。為獲取必要的每通道 MIPS 速率，大多數(shù)基站都將數(shù)字信號(hào)處理器 (DSP)、現(xiàn)場(chǎng)可編程門陣列 (FPGA) 和高速一般用途處理器結(jié)合起來使用。FPGA 用于處理速率要求超過 DSP 范圍的碼片速率處理。DSP 通常用于符號(hào)碼率處理段。一般用途處理器則管理整個(gè)系統(tǒng)。
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