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在芯片設(shè)計中會經(jīng)常使用到ROM，而ROM又經(jīng)常作為片外存儲器被所設(shè)計的芯片進行讀寫操作，在這里就需要
設(shè)計接口電路用來配合ROM和設(shè)計的芯片。ROM 多為異步工作方式，如果設(shè)計的電路為同步電路，之間又存在著接口時
序配合的問題。文中介紹一種基于狀態(tài)機的ROM接口電路模型。該模型有兩個特點：一是采用狀態(tài)機實現(xiàn)同步時序電路
與ROM異步時序電路的接口時序配合；二是實現(xiàn)與具有不同時間參數(shù)ROM接口電路的兼容。該模型的設(shè)計結(jié)果通過了
FPOA驗證。并在ASIC芯片中得到運用。
設(shè)計接口電路用來配合ROM和設(shè)計的芯片。ROM 多為異步工作方式，如果設(shè)計的電路為同步電路，之間又存在著接口時
序配合的問題。文中介紹一種基于狀態(tài)機的ROM接口電路模型。該模型有兩個特點：一是采用狀態(tài)機實現(xiàn)同步時序電路
與ROM異步時序電路的接口時序配合；二是實現(xiàn)與具有不同時間參數(shù)ROM接口電路的兼容。該模型的設(shè)計結(jié)果通過了
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