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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的差分信號阻抗匹配

      基于FPGA的差分信號阻抗匹配

      2011-01-04 | rar | 652 | 次下載 | 5積分

      資料介紹

      為了節(jié)約PCB板空間，充分靈活利用FPGA內(nèi)部資源，對FPGA內(nèi)置差分信號匹配終端進(jìn)行研究。根據(jù)差分信號阻抗匹配的基礎(chǔ)理論，在自制的PCB電路板上利用差分信號線傳遞時鐘和圖像數(shù)據(jù)。在FPGA內(nèi)設(shè)置不同類型的片內(nèi)匹配終端，通過示波器觀察時鐘、圖像數(shù)據(jù)，利用Visual DSP++軟件自帶的Image Viewer功能觀察圖像。結(jié)果表明，使用片內(nèi)匹配終端不會惡化差分信號，并能大大節(jié)省PCB板空間，且終端匹配更靈活。
      Abstract:
      ?In order to save PCB board space，fully flexible use of FPGA internal resources，it did some research about the terminal in the FPGA which was used to match the differential signal.According to the basic theory about impedance match-ing of differential signal,the clock and image data by differential signal line in the self-made PCB circuit board was trans-mitted.The different OCT（on-chip termination）was set in FPGA，and the clock and image data signals through the oscillo-scope was observed the image by Image Viewer tool in Visual DSP++was also observed.The results show that the use of on-chip differential signal matched termination does not deteriorate dofferential signal,greatly reduces PCB board space，and makes the matching about terminal more flexible.
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