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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>高輸出頻率GPS接收機(jī)FPGA優(yōu)化設(shè)計

      高輸出頻率GPS接收機(jī)FPGA優(yōu)化設(shè)計

      2011-09-01 | pdf | 863 KB | 次下載 | 免費

      資料介紹

      為使DSP芯片有充裕的資源和時間用于復(fù)雜的導(dǎo)航計算，輸出高頻率的解算結(jié)果，論文通過資源優(yōu)化，只采用FPGA邏輯電路實現(xiàn)了GPS信號的捕獲、跟蹤、幀同步、衛(wèi)星自動搜索、偽距信息生成等基帶處理功能，并整理了電文、歷書、偽距信息、多普勒頻移的格式，方便傳輸。實驗表明，論文提出的實現(xiàn)方案可行有效，定位頻率可達(dá)100 Hz。

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