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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>Reference Design Optimizing FPGA Utilization and Data Throughput for Very High Channel Count Automatic Testers

      Reference Design Optimizing FPGA Utilization and Data Throughput for Very High Channel Count Automatic Testers

      2017-05-02 | pdf | 6.63 MB | 次下載 | 免費

      資料介紹

      　　泰德- 01051參考設計用來展示優(yōu)化通道密度、集成、功耗、時鐘分布和信號鏈的性能非常高的通道數(shù)等數(shù)據(jù)采集（采集）系統(tǒng)自動測試設備中使用的那些（吃）。 使用序列化器，如TI的DS90C383B，結合許多同時采樣ADC輸出成幾個LVDS行可以顯著降低針主機FPGA必須處理的數(shù)量。 因此，單個FPGA可以處理顯著增加數(shù)量的采集渠道和董事會路由復雜度大大降低。

      Reference Design Optimizing FPGA Utilization and Data Throughput for Very High Channel Count Automatic Testers

      　　FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎上進一步發(fā)展的產(chǎn)物。它是作為專用集成電路（ASIC）領域中的一種半定制電路而出現(xiàn)的，既解決了定制電路的不足，又克服了原有可編程器件門電路數(shù)有限的缺點。

      Reference Design Optimizing FPGA Utilization and Data Throughput for Very High Channel Count Automatic Testers

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