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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>Max II設(shè)備的數(shù)據(jù)手冊(cè)免費(fèi)下載

      Max II設(shè)備的數(shù)據(jù)手冊(cè)免費(fèi)下載

      2019-03-28 | rar | 1.01 MB | 次下載 | 免費(fèi)

      資料介紹

      　　本節(jié)為設(shè)計(jì)人員提供Max II設(shè)備的數(shù)據(jù)表規(guī)范。本章包含內(nèi)部架構(gòu)、聯(lián)合測(cè)試行動(dòng)組（JTAG）和系統(tǒng)內(nèi)可編程性（ISP）信息、直流操作條件、交流定時(shí)參數(shù)和Max II設(shè)備的訂購(gòu)信息的特征定義。

      　　本節(jié)包括以下章節(jié)：

      　　第1章。介紹

      　　第2章。Max II建筑

      　　第3章。JTAG和系統(tǒng)內(nèi)可編程性

      　　第4章。Max II設(shè)備中的熱插接和通電重置

      　　第5章。直流和開關(guān)特性

      　　第6章。參考和訂購(gòu)信息

      　　請(qǐng)參閱各章了解其具體的修訂歷史。有關(guān)每個(gè)章節(jié)更新時(shí)間的信息，請(qǐng)參閱完整手冊(cè)中的章節(jié)修訂日期部分。

      　　Max?II系列即時(shí)開啟、非易失性CPLD基于0.18μm、6層金屬閃光工藝，密度從240到2210個(gè)邏輯元件（LES）（128到2210個(gè)等效宏電池）和8 kbit的非易失性存儲(chǔ)。與其他CPLD結(jié)構(gòu)相比，Max II設(shè)備提供高I/O計(jì)數(shù)、快速性能和可靠的安裝。具有Multivolt?核心、用戶閃存（UFM）塊和增強(qiáng)的系統(tǒng)可編程性（ISP），Max II設(shè)備旨在降低成本和功率，同時(shí)為總線橋接、I/O擴(kuò)展、上電重置（PoR）和順序控制以及設(shè)備配置C等應(yīng)用提供可編程解決方案。

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