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      電子發(fā)燒友網(wǎng)>電子資料下載>電源技術(shù)>基于多閾值技術(shù)的超低功耗電路設(shè)計(jì)

      基于多閾值技術(shù)的超低功耗電路設(shè)計(jì)

      2010-02-24 | rar | 221 | 次下載 | 3積分

      資料介紹

      隨著工藝進(jìn)入深亞微米階段,漏電流帶來(lái)的靜態(tài)功耗已經(jīng)成為不可忽視的部分。多閾值CMOS技術(shù)是一種降低電路漏電流功耗的有效方法。本文在延遲不敏感異步電路中應(yīng)用多閾值CMOS技術(shù),該設(shè)計(jì)能顯著的降低功耗,同時(shí)解決了同步電路存在的問(wèn)題,比如sleep信號(hào)的產(chǎn)生,存儲(chǔ)元件在sleep模式下數(shù)據(jù)丟失。這對(duì)深亞微米低功耗電路的設(shè)計(jì)具有一定的實(shí)際意義。
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