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      電子發(fā)燒友網(wǎng)>電子資料下載>電源技術(shù)>HEVC中CABAC解碼器的硬件設(shè)計與實現(xiàn)

      HEVC中CABAC解碼器的硬件設(shè)計與實現(xiàn)

      2017-11-15 | rar | 1.16 MB | 次下載 | 免費(fèi)

      資料介紹

      　　隨著高清視頻應(yīng)用日益增加，對視頻壓縮性能提出了更高的要求。因此，2010年4月國際電信聯(lián)盟電信標(biāo)準(zhǔn)化部門（IUT-T）的視頻編碼專家組（VCEG）和國際標(biāo)準(zhǔn)化組織（ISO）的動態(tài)圖像專家組（MPEC）組建視頻編碼聯(lián)合組（JCT-VC），聯(lián)手制定了新一代視頻編碼標(biāo)準(zhǔn)HEVC。HEVC采用CABAC的熵編碼方式，獲得了高的壓縮效率，但實現(xiàn)結(jié)構(gòu)復(fù)雜，諸多的迭代運(yùn)算，加上各級之間的相關(guān)特性使其很難并行化，在硬件實現(xiàn)上占用較多的面積并且速度較慢。

      　　文中設(shè)計了一個高性能的CABAC解碼器，通過對單周期解碼1bit的結(jié)構(gòu)進(jìn)行改進(jìn)，優(yōu)化了面積和關(guān)鍵路徑等特性，提高了解碼性能。該設(shè)計采用Verilog HDL進(jìn)行建模和仿真，并利用Synopsys公司的相關(guān)T具進(jìn)行了面積和時序分析。

      HEVC中CABAC解碼器的硬件設(shè)計與實現(xiàn)

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