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關(guān)于Actel 的FPGA的譯碼器的VHDL源代碼-
關(guān)于Actel 的FPGA的譯碼器的VHDL源代碼。適合感興趣的學(xué)習(xí)者學(xué)習(xí),可以提高自己的能力,大家可以多交流哈
部分文件列表
文件名 | 文件大小 | 修改時間 |
Decoder_FPGA | 1KB | 2009-02-17 15:36:28 |
Decoder_FPGA/Decoder.prj | 8KB | 2008-08-18 16:49:12 |
Decoder_FPGA/viewdraw | 1KB | 2009-02-17 15:36:28 |
Decoder_FPGA/viewdraw/viewdraw.ini | 2KB | 2008-08-18 16:49:08 |
Decoder_FPGA/viewdraw/wir | 1KB | 2009-02-17 15:36:28 |
Decoder_FPGA/viewdraw/vf | 1KB | 2009-02-17 15:36:28 |
Decoder_FPGA/viewdraw/vf/project.lst | 1KB | 2008-08-18 16:49:08 |
Decoder_FPGA/viewdraw/sym | 1KB | 2009-02-17 15:36:28 |
Decoder_FPGA/viewdraw/sch | 1KB | 2009-02-17 15:36:28 |
Decoder_FPGA/synthesis | 1KB | 2009-02-17 15:36:28 |
Decoder_FPGA/synthesis/Decoder.areasrr | 1KB | 2008-07-10 13:38:48 |
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