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      電子發(fā)燒友網(wǎng)>電子資料下載>電源技術(shù)>在電源上疊加一個脈沖信號，模擬一個干擾信號

      在電源上疊加一個脈沖信號，模擬一個干擾信號

      2022-01-07 | pdf | 未知 | 次下載 | 2積分

      資料介紹

      原理：通過MCU控制開關(guān)K1通斷，產(chǎn)生尖脈沖疊加到電源上，電位器對脈沖幅度、波形進(jìn)行調(diào)節(jié)。通過按鍵(S1/2/3)選擇輸出不同頻率，及占空比可調(diào)，使干擾測試更加靈活。這里的MCU用CPLD代替，因有現(xiàn)成的CPLD板子，故用的Verilog寫的，代碼如下： 1 module Counter( 2 rst_n, 3...
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