熟悉常用邏輯器件的分類；了解常用可編程邏輯器件的內(nèi)部結(jié)構(gòu)；熟悉可編程邏輯器件的開發(fā)流程；掌握MAX+plusII軟件。
重點：基于MAX+plusII軟件進行PLD設(shè)計的流程。
難點：PLD的內(nèi)部結(jié)構(gòu)。
一、可編程邏輯器件的基本概念
1、發(fā)展歷程
當今社會是數(shù)字化的社會，是數(shù)字集成電路廣泛應(yīng)用的社會。數(shù)字集成電路本身在不斷地進行更新?lián)Q代。它由早期的電子管、晶體管、小中規(guī)模集成電路、發(fā)展到超大規(guī)模集成電路(VLSIC，幾萬門以上)以及許多具有特定功能的專用集成電路。但是，隨著微電子技術(shù)的發(fā)展，設(shè)計與制造集成電路的任務(wù)已不完全由半導(dǎo)體廠商來獨立承擔。系統(tǒng)設(shè)計師們更愿意自己設(shè)計專用集成電路(ASIC)芯片，而且希望ASIC的設(shè)計周期盡可能短，最好是在實驗室里就能設(shè)計出合適的ASIC芯片，并且立即投入實際應(yīng)用之中，因而出現(xiàn)了現(xiàn)場可編程邏輯器件(FPLD)，其中應(yīng)用最廣泛的當屬現(xiàn)場可編程門陣列(FPGA)和復(fù)雜可編程邏輯器件(CPLD)。
FPGA(現(xiàn)場可編程門陣列)與 CPLD(復(fù)雜可編程邏輯器件)都是可編程邏輯器件，它們是在PAL，GAL等邏輯器件的基礎(chǔ)之上發(fā)展起來的。同以往的PAL，GAL等相比較，F(xiàn)PGA／CPLD的規(guī)模比較大，它可以替代幾十甚至幾千塊通用IC芯片。這樣的FPGA／CPLD實際上就是一個子系統(tǒng)部件。這種芯片受到世界范圍內(nèi)電子工程設(shè)計人員的廣泛關(guān)注和普遍歡迎。經(jīng)過了十幾年的發(fā)展，許多公司都開發(fā)出了多種可編程邏輯器件。比較典型的就是Xilinx公司的FPGA器件系列和Altera公司的CPLD器件系列，它們開發(fā)較早，占用了較大的PLD市場。
2、PLD的優(yōu)點
FPGA／CPLD芯片都是特殊的ASIC芯片，它們除了具有ASIC的特點之外，還具有以下幾個優(yōu)點：
① 隨著VlSI(Very Large Scale IC，超大規(guī)模集成電路)工藝的不斷提高單一芯片內(nèi)部可以容納上百萬個晶體管， FPGA／CPLD芯片的規(guī)模也越來越大，其單片邏輯門數(shù)已達到上百萬門，它所能實現(xiàn)的功能也越來越強，同時也可以實現(xiàn)系統(tǒng)集成。
② FPGA／CPLD芯片在出廠之前都做過百分之百的測試，不需要設(shè)計人員承擔投片風險和費用，設(shè)計人員只需在自己的實驗室里就可以通過相關(guān)的軟硬件環(huán)境來完成芯片的最終功能設(shè)計。所以， FPGA／CPLD的資金投入小，節(jié)省了許多潛在的花費。
③ 用戶可以反復(fù)地編程、擦除、使用或者在外圍電路不動的情況下用不同軟件就可實現(xiàn)不同的功能。所以，用FPGA／PLD 試制樣片，能以最快的速度占領(lǐng)市場。 FPGA／CPLD軟件包中有各種輸入工具和仿真工具，及版圖設(shè)計工具和編程器等全線產(chǎn)品，電路設(shè)計人員在很短的時間內(nèi)就可完成電路的輸入、編譯、優(yōu)化、仿真，直至最后芯片的制作。 當電路有少量改動時，更能顯示出FPGA／CPLD的優(yōu)勢。電路設(shè)計人員使用FPGA／CPLD進行電路設(shè)計時，不需要具備專門的IC(集成電路)深層次的知識， FPGA／CPLD軟件易學(xué)易用，可以使設(shè)計人員更能集中精力進行電路設(shè)計，快速將產(chǎn)品推向市場。
3、PLD的內(nèi)部結(jié)構(gòu)
盡管FPGA，CPLD和其它類型PLD的結(jié)構(gòu)各有其特點和長處，但概括起來，它們是由三大部分組成的，
① 一個二維的邏輯塊陣列，構(gòu)成了PLD器件的邏輯組成核心。
② 輸入／輸出塊：
③ 連接邏輯塊的互連資源。連線資源：由各種長度的連線線段組成，其中也有一些可編程的連接開關(guān)，它們用于邏輯塊之間、邏輯塊與輸入／輸出塊之間的連接。