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本文設(shè)計(jì)了 CPU（ ZSP_NEO ）和內(nèi)部存儲(chǔ)器的接口電路，這個(gè)接口電路同時(shí)提供一
個(gè)接口滿足DMA 對(duì)內(nèi)部存儲(chǔ)器的訪問(wèn)，并完成模塊驗(yàn)證。
本設(shè)計(jì)中使用了兩個(gè) IP：ZSP_NEO 處理器核，以及Artisan 提供的SMIC 的 0.18μm
工藝的存儲(chǔ)器模塊，分別研究了他們的相關(guān)功能和相關(guān)接口，主要包括：讀寫(xiě)功能、讀寫(xiě)時(shí)序、控制信號(hào)等。同時(shí)，也根據(jù)存儲(chǔ)器的情況選擇了一個(gè)合適的直接存儲(chǔ)器存?。―MA，Direct Memory Access）的操作協(xié)議。
本設(shè)計(jì)中主要涉及系統(tǒng)級(jí)設(shè)計(jì)（ SoC ）的一些相關(guān)知識(shí)、IP 的運(yùn)用、Verilog 代碼的
編寫(xiě)，及系統(tǒng)驗(yàn)證等。
個(gè)接口滿足DMA 對(duì)內(nèi)部存儲(chǔ)器的訪問(wèn)，并完成模塊驗(yàn)證。
本設(shè)計(jì)中使用了兩個(gè) IP：ZSP_NEO 處理器核，以及Artisan 提供的SMIC 的 0.18μm
工藝的存儲(chǔ)器模塊，分別研究了他們的相關(guān)功能和相關(guān)接口，主要包括：讀寫(xiě)功能、讀寫(xiě)時(shí)序、控制信號(hào)等。同時(shí)，也根據(jù)存儲(chǔ)器的情況選擇了一個(gè)合適的直接存儲(chǔ)器存?。―MA，Direct Memory Access）的操作協(xié)議。
本設(shè)計(jì)中主要涉及系統(tǒng)級(jí)設(shè)計(jì)（ SoC ）的一些相關(guān)知識(shí)、IP 的運(yùn)用、Verilog 代碼的
編寫(xiě)，及系統(tǒng)驗(yàn)證等。
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