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      利用Catapult LB 創(chuàng)建高層次綜合工藝庫

      2010-07-04 | rar | 344 | 次下載 | 3積分

      資料介紹

      隨著半導(dǎo)體制造工藝的持續(xù)縮小，在90 納米及以下的工藝中，時序、面積、
      功耗以及可制造性的問題都日趨復(fù)雜。設(shè)計者希望在電子系統(tǒng)級 (ESL) 設(shè)計階
      段，就能知道他們的設(shè)計在目標(biāo)工藝下能否達(dá)到預(yù)期要求。Mentor Graphics 公司
      的Catapult Library Builder(以下簡稱Catapult LB)，可以幫助半導(dǎo)體供應(yīng)商提取高
      層次綜合(high level synthesis)所需要的工藝庫。該工藝庫能讓客戶把C/C++設(shè)計
      直接映射到特定的半導(dǎo)體工藝庫，進(jìn)行性能和面積的預(yù)估分析，盡早對設(shè)計進(jìn)行
      優(yōu)化和檢驗，增加設(shè)計成功的機(jī)會，同時該工藝庫的建立也有利于半導(dǎo)體代工廠
      商對新的先進(jìn)工藝的推廣。本文以中芯國際集成電路制造有限公司(SMIC) 90 納
      米的邏輯工藝庫為例，介紹如何使用Catapult LB 為半導(dǎo)體供應(yīng)商的特定工藝建
      庫，幫助客戶實現(xiàn)從C/C++到GDSII 的先進(jìn)設(shè)計流程。文章首先介紹Catapult LB
      的建庫流程，然后介紹Catapult LB 針對ASIC 工藝庫不同的元件如標(biāo)準(zhǔn)單元、
      存儲單元等建庫的具體方法，最后介紹如何驗證元件庫并加快建庫過程。
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