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該設(shè)計采用63位的pn碼作為擴(kuò)頻調(diào)制的碼序列,在發(fā)送端,對信息碼進(jìn)行擴(kuò)頻調(diào)制;在接收端,對收到的擴(kuò)頻調(diào)制信號進(jìn)行解擴(kuò),增強(qiáng)了系統(tǒng)的抗干擾性和可靠性。同時在Altera公司的Quartus II軟件中,使用硬件描述語言VHDL和原理圖相結(jié)合的方法進(jìn)行了電路的設(shè)計實(shí)現(xiàn)。通過把電路下載到Altera公司的CycloneIII 的EP3C10E144C8N芯片中調(diào)試,驗(yàn)證了擴(kuò)頻系統(tǒng)的可行性。
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