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標(biāo)簽 > 仿真
仿真(Simulation),即使用項(xiàng)目模型將特定于某一具體層次的不確定性轉(zhuǎn)化為它們對(duì)目標(biāo)的影響,該影響是在項(xiàng)目仿真項(xiàng)目整體的層次上表示的。項(xiàng)目仿真利用計(jì)算機(jī)模型和某一具體層次的風(fēng)險(xiǎn)估計(jì),一般采用蒙特卡洛法進(jìn)行仿真。
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基于STM32控制直流電機(jī)加減速正反轉(zhuǎn)proteus仿真設(shè)計(jì)
AD封裝庫(kù)元器件庫(kù)大全: 封裝庫(kù) 資源目錄: 本設(shè)計(jì): 基于STM32控制直流電機(jī)加減速正反轉(zhuǎn)proteus仿真設(shè)計(jì)(程序+仿真+設(shè)計(jì)報(bào)告+講解視頻) ...
可將自己新建的項(xiàng)目加載到 HMI 設(shè)備并在運(yùn)行系統(tǒng)中執(zhí)行。 為此,組態(tài)設(shè)備和 HMI 設(shè)備之間必須建立連接。 如果您沒(méi)有使用 HMI 設(shè)備,則...
HFSS 2019 R2版本發(fā)布中,新增了一項(xiàng)新的功能:微放電仿真(Multi paction solver)。太空環(huán)境下,射頻擊穿效應(yīng)導(dǎo)致設(shè)備失效。微...
Zynq UltraScale+ MPSoC在仿真板上的運(yùn)行展示
Xilinx展示Zynq UltraScale + MPSoC在由6個(gè)FPGA組成的硬件仿真板上運(yùn)行,以實(shí)現(xiàn)四核ARM Cortex-A53,雙核ARM...
FPGA奇偶校驗(yàn)的基本原理及實(shí)現(xiàn)方法
在數(shù)字電路中,數(shù)據(jù)的正確性非常重要。為了保證數(shù)據(jù)的正確性,在傳輸數(shù)據(jù)時(shí)需要添加一些冗余信息,以便在接收端進(jìn)行校驗(yàn)。其中一種常用的校驗(yàn)方式是奇偶校驗(yàn)(Pa...
基于FPGA的自適應(yīng)閾值分割算法實(shí)現(xiàn)
在圖像預(yù)處理中經(jīng)常會(huì)碰到圖像分割問(wèn)題,把感興趣的目標(biāo)從背景圖像中提取出來(lái),而經(jīng)常使用的是簡(jiǎn)單的全局閾值分割配置,用一個(gè)固定常數(shù)作為二值分割閾值,從而得到...
2021-08-23 標(biāo)簽:fpgaFPGA設(shè)計(jì)算法 3653 0
基于MATLAB和HFSS聯(lián)合仿真的平面反射陣列天線
本案例設(shè)計(jì)了一種單層風(fēng)車(chē)型單元,以拓寬反射陣列天線的帶寬。為了獲得足夠的相位范圍,利用風(fēng)車(chē)環(huán)貼片和圓環(huán)貼片來(lái)實(shí)現(xiàn)多諧振狀態(tài)。所提出的單元在HFSS仿真獲...
永磁同步電機(jī)降階模型ECE抽取是通過(guò)對(duì)永磁同步電機(jī)有限元結(jié)果進(jìn)行降階抽取,等效抽取的結(jié)果是基于有限元計(jì)算得到的數(shù)據(jù)表,在控制系統(tǒng)聯(lián)合仿真過(guò)程中只需通過(guò)查...
2023-08-14 標(biāo)簽:永磁同步電機(jī)電機(jī)仿真 3639 0
當(dāng)我們想在gazebo中仿真一個(gè)比較逼真的機(jī)器人時(shí),光有機(jī)器人的樣子是遠(yuǎn)遠(yuǎn)不夠的,一個(gè)真實(shí)的機(jī)器人往往附帶著各種各樣的傳感器,比如用來(lái)估計(jì)機(jī)器人位置的編...
基于Multisim的壓頻轉(zhuǎn)換電路設(shè)計(jì)與仿真
壓頻轉(zhuǎn)換電路的目標(biāo)是將電壓的變化轉(zhuǎn)換為頻率的變化。電壓/頻率變換器的輸出信號(hào)頻率f與輸入電壓u的大小成正比。設(shè)計(jì)電壓轉(zhuǎn)換頻電路,就得選擇好的脈沖輸出電路...
基于ADS平臺(tái)改進(jìn)型Doherty電路設(shè)計(jì)與仿真
在現(xiàn)代數(shù)字通信中,調(diào)制技術(shù)運(yùn)用了非恒包絡(luò)調(diào)制方式,峰值和平均值相差較大,描述為峰均比(PAR),為了滿足線性度的要求,則往往采用功率回退的方法來(lái)達(dá)到線性...
2018-05-17 標(biāo)簽:電路設(shè)計(jì)仿真ads 3624 0
FPGA之硬件語(yǔ)法篇:用Verilog代碼仿真與驗(yàn)證數(shù)字硬件電路
大家都知道軟件設(shè)計(jì)使用軟件編程語(yǔ)言,例如我們熟知的C、Java等等,而FPGA設(shè)計(jì)使用的是HDL語(yǔ)言,例如VHDL和Verilog HDL。說(shuō)的直白點(diǎn),...
SPI總線是什么?FPGA串行外圍接口SPI設(shè)計(jì)應(yīng)如何實(shí)現(xiàn)?
在數(shù)據(jù)串并轉(zhuǎn)換的過(guò)程中, 必須用到寄存器來(lái)存放臨時(shí)數(shù)據(jù)。一般情況下,發(fā)送數(shù)據(jù)需要1 個(gè)發(fā)送寄存器,接收數(shù)據(jù)需要1個(gè)接收寄存器,則至少需要2 個(gè)寄存器。在...
基于可編程邏輯器件的PSK數(shù)字調(diào)制系統(tǒng)的設(shè)計(jì)及波形仿真與硬件調(diào)試
現(xiàn)代通信系統(tǒng)要求通信距離遠(yuǎn)、通信容量大、傳輸質(zhì)量好。作為其關(guān)鍵技術(shù)之一的調(diào)制解調(diào)技術(shù)一直是人們研究的一個(gè)重要方向。從模擬調(diào)制到數(shù)字調(diào)制,從二進(jìn)制發(fā)展到多...
本案例的目的是設(shè)計(jì)一個(gè)由圓柱形納米棒組成的衍射超透鏡,人為調(diào)整納米棒的半徑和排列可以在超透鏡表面上產(chǎn)生所需的相位分布。該設(shè)計(jì)的近場(chǎng)和遠(yuǎn)場(chǎng)分析在Ansys...
單運(yùn)放電壓電流轉(zhuǎn)換電路的工作原理分析
圖5.39為單運(yùn)放電壓—電流轉(zhuǎn)換電路圖,首先對(duì)電路進(jìn)行工作原理分析:U1A、R1、R2、R3和R4實(shí)現(xiàn)差分放大功能。正常工作時(shí)節(jié)點(diǎn)電壓VN=、VP=,根...
現(xiàn)代FPGA的體系結(jié)構(gòu)包括CLB陣列、塊RAM、乘法器、DSP、IOB和數(shù)字時(shí)鐘管理器(DCM)。延遲鎖定環(huán)(DLL)用于賦值具有均勻時(shí)鐘偏移的時(shí)鐘。X...
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