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可編程邏輯

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邏輯器件可分為兩大類(lèi) – 固定邏輯器件和可編程邏輯器件。正如其命名一樣，固定邏輯器件中的電路是永久性的，它們完成一種或一組功能 —— 一旦制造完成，就無(wú)法改變。

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可編程邏輯技術(shù)

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載8：Spartan

Spartan-6的時(shí)鐘緩沖器/多路復(fù)用器（BUFG或BUFPLL）可以直接驅(qū)動(dòng)時(shí)鐘輸入信號(hào)到時(shí)鐘線(xiàn)上，或者通過(guò)多路復(fù)用器在兩個(gè)不相關(guān)的信號(hào)甚至異步時(shí)鐘...

2017-02-11 標(biāo)簽：Xilinx 可編程邏輯 Spartan 1156 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載7：Spartan

時(shí)鐘布線(xiàn)資源具有高速、低SKEW的特點(diǎn)，它對(duì)系統(tǒng)設(shè)計(jì)非常重要，即使系統(tǒng)速率不高，也應(yīng)該關(guān)注時(shí)鐘設(shè)計(jì)，以消除潛在的時(shí)鐘危險(xiǎn)。

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 746 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載6：Spartan

Spartan-6的每個(gè)SLICE 有8個(gè)存儲(chǔ)元件，可以實(shí)現(xiàn)存儲(chǔ)功能。

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 1339 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載4：2.1 Spartan

Spartan-6每個(gè)CLB模塊里包含兩個(gè)SLICE。CLB通過(guò)交換矩陣和外部通用邏輯陣列相連，如圖2-1和圖2-2所示。底部的SLICE標(biāo)號(hào)為SLIC...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 886 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載27：Spartan

Vrtex-6 HXT器件內(nèi)的GTH模塊比GTX有更高的線(xiàn)速率，用它可以實(shí)現(xiàn)最高性能的高速串行收發(fā)器。GTH具有如下特性。

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 1726 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載26：Spartan

Virtex-6支持多種高速串行接口，其中高速串行模塊GTX收發(fā)器可以實(shí)現(xiàn)150Mbit/s～6.5Gbit/s的線(xiàn)速率。GTX收發(fā)器是芯片與芯片之間、...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 900 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載25：Spartan

Virtex-6每個(gè)I/O片（I/O Tile）包含兩個(gè)IOB、兩個(gè)ILOGIC、兩個(gè)OLOGIC 和兩個(gè)IODELAY，如圖5-24 所示。

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 2989 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載24：Spartan

為了適應(yīng)越來(lái)越復(fù)雜的DSP運(yùn)算，Virtex-6中嵌入了功能更強(qiáng)大的DSP48E1 SLICE，簡(jiǎn)化的DSP48E1模塊如圖5-16所示。

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 1783 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載23：Spartan

Virtex-6中嵌入BRAM，大大拓展了FPGA的應(yīng)用范圍和應(yīng)用的靈活性。BRAM可被配置為單端口RAM、雙端口RAM、內(nèi)容地址存儲(chǔ)器（CAM）以及F...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 1233 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載22：Spartan

除了豐富的時(shí)鐘網(wǎng)絡(luò)以外，Xilinx還提供了強(qiáng)大的時(shí)鐘管理功能，提供更多更靈活的時(shí)鐘。Xilinx在時(shí)鐘管理上不斷改進(jìn)，從Virtex-4的純數(shù)字管理單...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 1406 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載21：Spartan

為了更好的控制時(shí)鐘，Virtex-6器件分成若干個(gè)時(shí)鐘區(qū)域，最小器件有6個(gè)區(qū)域，最大器件有18個(gè)區(qū)域。每個(gè)時(shí)鐘區(qū)域高40個(gè)CLB。在時(shí)鐘設(shè)計(jì)中，推薦使用...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 1449 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載20：Spartan

CLB是實(shí)現(xiàn)時(shí)序電路和組合電路的主要邏輯資源。

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 724 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載19：Spartan

Virtex-6是Xilinx 在2009年2月推出的新一代旗艦產(chǎn)品，采用了第三代Xilinx ASMBL架構(gòu)、40nm 工藝，提供多達(dá)760000 個(gè)...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 657 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載18：Spartan

Spartan-6 LX平臺(tái)面向邏輯、DSP資源以及存儲(chǔ)模塊進(jìn)行了優(yōu)化，能夠以較低的功耗滿(mǎn)足更高的帶寬和性能需求；而Spartan-6 LXT面向邏輯、...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 643 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載17：Spartan

Spartan-6 FPGA系列為消費(fèi)、汽車(chē)、無(wú)線(xiàn)和其他價(jià)格敏感或大批量市場(chǎng)，提供了低風(fēng)險(xiǎn)和低成本的串行連接解決方案。

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 884 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載16：Spartan

Spartan-6器件具有2或4個(gè)專(zhuān)用嵌入式多端口存儲(chǔ)器控制器模塊（MCB），實(shí)現(xiàn)了到4個(gè)常見(jiàn)存儲(chǔ)器標(biāo)準(zhǔn)的簡(jiǎn)單連接：DDR3、DDR2、DDR 和LPD...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 953 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載15：Spartan

所有的Spartan-6 FPGA有高性能的可配置SelectIO驅(qū)動(dòng)器與接收器，支持非常廣泛的接口標(biāo)準(zhǔn)。可以通過(guò)編程控制I/O的輸出強(qiáng)度、斜率以及片上...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 7365 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載13：Spartan

Spartan-6中的BRAM存儲(chǔ)18Kbit數(shù)據(jù)，能配置成兩個(gè)獨(dú)立的9Kbit BRAM或者一個(gè)18Kbit BRAM。每個(gè)RAM可以通過(guò)兩個(gè)端口尋址...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 838 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載12：Spartan

Spartan-6 器件最多包含6 個(gè)CMT，12 個(gè)PLL。PLL 的主要用途是作為頻率合成器，產(chǎn)生更寬范圍的頻率輸出，在與CMT 中的DCM 連接時(shí)...

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 1554 0

Xilinx可編程邏輯器件設(shè)計(jì)與開(kāi)發(fā)（基礎(chǔ)篇）連載11：Spartan

Spartan-6 CMT是一個(gè)靈活、高性能的時(shí)鐘管理模塊。它位于芯片中央、垂直的全局時(shí)鐘網(wǎng)絡(luò)旁。如圖2-17所示，它包含一個(gè)PLL和兩個(gè)DCM。

2017-02-11 標(biāo)簽：賽靈思 Xilinx 可編程邏輯 1117 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線(xiàn)束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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powerlink

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面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

AXI

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AXI是一種總線(xiàn)協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線(xiàn)。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪(fǎng)問(wèn)和亂序訪(fǎng)問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線(xiàn)傳輸中的概念。特性阻抗是射頻傳輸線(xiàn)影響無(wú)線(xiàn)電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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紅外觸摸屏

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