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標(biāo)簽 > altera
自二十年前發(fā)明世界上第一個(gè)可編程邏輯器件開始,Altera公司(阿爾特拉)(NASDAQ:ALTR)秉承了創(chuàng)新的傳統(tǒng),是世界上“可編程芯片系統(tǒng)”(SOPC)解決方案倡導(dǎo)者。Altera結(jié)合帶有軟件工具的可編程邏輯技術(shù)、知識(shí)產(chǎn)權(quán)(IP)和技術(shù)服務(wù),在世界范圍內(nèi)為14,000多個(gè)客戶提供高質(zhì)量的可編程解決方案。
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課程6:Quartus II使用簡(jiǎn)介與第一個(gè)工程實(shí)例
Quartus II支持Altera的IP核,包含了LPM/MegaFunction宏功能模塊庫(kù),使用戶可以充分利用成熟的模塊,簡(jiǎn)化了設(shè)計(jì)的復(fù)雜性、加快...
2019-12-23 標(biāo)簽:alteraip核quartus ii 3945 0
FPGA視頻教程:BJ-EPM240學(xué)習(xí)板介紹
BJ-EPM240學(xué)習(xí)板的主芯片使用的是Altera公司的MAXII系列EPM240T100C5,該芯片有240個(gè)邏輯單元,等效宏單元192個(gè),資源比較...
基于EP4CE10F17C8N芯片詳解Altera Cyclone系列器件命名規(guī)則
器件系列 + 器件類型(是否含有高速串行收發(fā)器) + LE邏輯單元數(shù)量 + 封裝類型 + 高速串行收發(fā)器的數(shù)量(沒(méi)有則不寫) + 引腳數(shù)目 + 器件正...
基于ICR技術(shù)的FPGA配置電路硬件設(shè)計(jì)及其工作原理
根據(jù)課題要求,設(shè)計(jì)FPGA部分硬件電路如圖1所示。FPGA芯片選用Altera公司的中檔器件FLEX-EPF10K10LC84-4,他是基于SRAM L...
采用Altera的CPLD器件實(shí)現(xiàn)時(shí)間統(tǒng)一系統(tǒng)的B碼源設(shè)計(jì)
隨著電子技術(shù)的發(fā)展,對(duì)遙測(cè)信號(hào)的幀結(jié)構(gòu)的可編程度、集成度的要求越來(lái)越高,用于時(shí)間統(tǒng)一系統(tǒng)的B碼源的設(shè)計(jì)也趨于高度集成化。為了適應(yīng)現(xiàn)代靶場(chǎng)試驗(yàn)任務(wù)的要求,...
2019-02-06 標(biāo)簽:fpgaaltera計(jì)數(shù)器 3215 0
作者:張澤小腳丫STEP 導(dǎo)讀:FPGA(Field Programmable Gate Array)譯作中文為:現(xiàn)場(chǎng)可編程門陣列,也就是設(shè)計(jì)者可以在現(xiàn)...
2018-06-14 標(biāo)簽:fpgaFPGA設(shè)計(jì)Altera 7029 0
Arria10自動(dòng)生成預(yù)定義的signaltap II文件
為Arria10自動(dòng)生成預(yù)定義的signaltap II文件
簡(jiǎn)述使用QII狀態(tài)機(jī)向?qū)绾蝿?chuàng)建一個(gè)狀態(tài)機(jī)
如何使用QII狀態(tài)機(jī)向?qū)?chuàng)建一個(gè)狀態(tài)機(jī)
2018-06-20 標(biāo)簽:altera狀態(tài)機(jī)qii 4421 0
在Arria 10 PCI Express中更改串行和PIPE仿真的方法
如何在Arria 10 PCI Express (PCIe)中更改串行(Serial)和PIPE仿真
在設(shè)計(jì)商店中找到MAX 10產(chǎn)品系列的參考設(shè)計(jì)的操作
通過(guò)我們的設(shè)計(jì)商店找到MAX 10產(chǎn)品系列的參考設(shè)計(jì)
關(guān)于Nios II 以太網(wǎng)設(shè)計(jì)的調(diào)試技術(shù)(1)
Nios II 以太網(wǎng)設(shè)計(jì)的調(diào)試技術(shù) Part 1
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