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FPGA(Field-Programmable Gate Array),即現(xiàn)場可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點。
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基于FPGA的移位寄存器流水線結(jié)構(gòu)FFT處理器
快速傅里葉變換(FFT)在雷達(dá)、通信和電子對抗等領(lǐng)域有廣泛應(yīng)用。近年來現(xiàn)場可編程門陣列(FPGA)的飛速發(fā)展,與DSP技術(shù)相比,由于其并行信號處理結(jié)構(gòu),...
基于FPGA的DDR內(nèi)存條的控制研究與設(shè)計
DDR內(nèi)存條是由多顆粒的DDRSDKAM芯片互連組成,DDRSDRAM是雙數(shù)據(jù)率同步動態(tài)隨機(jī)存儲器的縮寫。DDRSDRAM采用雙數(shù)據(jù)速率接口,也就是在時...
大一學(xué)生先從C語言開始入門,在大一階段由于對計算機(jī)還非常陌生,因此不可能寫出一個具有完整圖形界面的軟件,重點以“與硬件無關(guān)的計算方法、數(shù)據(jù)結(jié)構(gòu)”為基礎(chǔ)學(xué)...
并行測試的實現(xiàn)途徑分為軟件方式和硬件方式。用軟件方式實現(xiàn)并行測試,關(guān)鍵是對測試任務(wù)的分解和調(diào)度,但可能會產(chǎn)生競爭或者死鎖現(xiàn)象。因此,在測試資源有限并且任...
基于FPGA進(jìn)行高速可變周期脈沖發(fā)生器設(shè)計
要求改變脈沖周期和輸出脈沖個數(shù)的脈沖輸出電路模塊在許多工業(yè)領(lǐng)域都有運(yùn)用。采用數(shù)字器件設(shè)計周期和輸出個數(shù)可調(diào)節(jié)的脈沖發(fā)生模塊是方便可行的。為了使之具有高速...
首次流片成功取決于整個系統(tǒng)硬件和相關(guān)軟件的驗證,有些公司提供的快速原型生成平臺具有許多調(diào)試功能,但這些平臺的價格非常高。
2011-01-18 標(biāo)簽:FPGA 1239 0
數(shù)字圖像空域濾波算法的FPGA設(shè)計與實現(xiàn)
本文采用的圖像是256×256大小的灰度圖像,濾波模板3×3大小。如何設(shè)計硬件電路來完成上述空域濾波算法,分析上述算法實現(xiàn)過程,可以得出結(jié)論,實現(xiàn)空域濾...
2011-01-18 1059 0
系統(tǒng)設(shè)計人員高度渴望擁有可擴(kuò)展的能夠適應(yīng)性能需求潛在變化以及能夠執(zhí)行高性能數(shù)據(jù)處理的架構(gòu)。而在FPGA內(nèi)部實施的控制平面/數(shù)據(jù)平面處理架構(gòu)就能夠有效滿足...
基于FPGA的LTE系統(tǒng)中轉(zhuǎn)換預(yù)編碼的設(shè)計
在比較已有FFT實現(xiàn)方法的基礎(chǔ)上,提出一種基于FPGA的通用FFT處理器的設(shè)計方案。這種FFT實現(xiàn)結(jié)構(gòu)根據(jù)不同的輸入數(shù)據(jù)長度動態(tài)配置成相應(yīng)的處理器,可以...
2011-01-16 標(biāo)簽:FPGA預(yù)編碼LTE系統(tǒng) 1195 0
基于FPGA視頻采集中的I2C總線設(shè)計與實現(xiàn)
在JPEG2000系統(tǒng)下,視頻采集系統(tǒng)是視頻采集功能的FPGA(現(xiàn)場可編程門陣列)前端系統(tǒng),是視頻圖像處理、應(yīng)用的前項通道。作為視頻采集系統(tǒng)的重要組成部...
基于FPGA實現(xiàn)多路模擬信號自適應(yīng)采集系統(tǒng)
本文提供的方式有效地解決了這個問題,既簡化了前端信號調(diào)理電路的復(fù)雜度,又充分利用了A/D轉(zhuǎn)換器的輸入電壓動態(tài)范圍和量化位數(shù)優(yōu)勢,實現(xiàn)了對多路模擬信號的自...
2011-01-14 標(biāo)簽:fpga 1849 0
航管二次監(jiān)視雷達(dá)地面詢問編碼器的FPGA設(shè)計
在航管體系中,常規(guī)模式及S模式技術(shù)用于監(jiān)視功能,建立在獨立編址,選擇詢問的基礎(chǔ)之上,信息交換是通過將上行詢問內(nèi)容和下行應(yīng)答內(nèi)容進(jìn)行脈沖編碼實現(xiàn)。
FPGA在智能壓力傳感器系統(tǒng)中的應(yīng)用設(shè)計
傳統(tǒng)氣體壓力測量儀器的傳感器部分與數(shù)據(jù)采集系統(tǒng)是分離的,抗干擾的能力較差,并且通常被測對象的壓力變化較快。因此不僅要求系統(tǒng)具有較快的數(shù)據(jù)吞吐速率,而且要...
基于VHDL的自動售貨機(jī)控制模塊FPGA實現(xiàn)
本文采用VHDL作為工具描述了自動售貨機(jī)控制模塊的邏輯控制電路,并在FPGA上實現(xiàn)。該自動售貨機(jī)能夠根據(jù)投入硬幣額度,按預(yù)定的要求在投入硬幣大于規(guī)定值時...
基于VHDL和FPGA的非對稱同步FIFO設(shè)計實現(xiàn)
本文采用VHDL描述語言,充分利用Xilinx公司Spartan II FPGA的系統(tǒng)資源,設(shè)計實現(xiàn)了一種非對稱同步FIFO,它不僅提供數(shù)據(jù)緩沖,而且能...
Cadence Incisive技術(shù)提升FPGA/ASIC設(shè)計效率
Cadence設(shè)計系統(tǒng)公司600多種新功能擴(kuò)展了指標(biāo)驅(qū)動型驗證(MDV)的范圍,幫助工程師實現(xiàn)更快、更全面的驗證閉合與硅實現(xiàn)。
賽靈思2011年CES消費(fèi)電子展相關(guān)信息發(fā)布
賽靈思將推出深受行業(yè)歡迎的 Spartan?-6 FPGA 消費(fèi)視頻套件的新版產(chǎn)品,為消費(fèi)電子系統(tǒng)設(shè)計人員提供一套完整的開發(fā)平臺,讓他們輕松應(yīng)用FPGA...
Verilog HDL與VHDL及FPGA的比較分析. Verilog HDL優(yōu)點:類似C語言,上手容易,靈活。大小寫敏感。在寫激勵和建模方面有優(yōu)勢。
2011-01-11 標(biāo)簽:FPGAVHDLVerilog HDL 1467 0
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