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FPGA(Field-Programmable Gate Array),即現(xiàn)場(chǎng)可編程門陣列,它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。它是作為專用集成電路(ASIC)領(lǐng)域中的一種半定制電路而出現(xiàn)的,既解決了定制電路的不足,又克服了原有可編程器件門電路數(shù)有限的缺點(diǎn)。
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出租車計(jì)價(jià)器的FPGA設(shè)計(jì)
出租車計(jì)價(jià)器的FPGA設(shè)計(jì) O 引 言 FPGA(Field Programmable Gate Array,現(xiàn)場(chǎng)可編程門陣列)是一種高密度...
2010-01-06 標(biāo)簽:fpga計(jì)價(jià)器 1911 0
FPGA開(kāi)發(fā)中按鍵消抖與單脈沖發(fā)生器電路
FPGA開(kāi)發(fā)中按鍵消抖與單脈沖發(fā)生器電路 FPGA開(kāi)發(fā)中常用到單脈沖發(fā)生器。一些文章介紹過(guò)產(chǎn)生單脈沖的電路,產(chǎn)生的單脈沖脈寬和相位都不能與時(shí)鐘同步,只能用在
華虹NEC高效nvSOC產(chǎn)品原型平臺(tái),有效縮短SoC產(chǎn)品開(kāi)發(fā)
華虹NEC高效nvSOC產(chǎn)品原型平臺(tái),有效縮短SoC產(chǎn)品開(kāi)發(fā)周期 上海華虹NEC電子有限公司(以下簡(jiǎn)稱“華虹NEC”)日前宣布成功推出nvSOC產(chǎn)品原...
FPGA單芯片四核二乘二取二的安全系統(tǒng) 引 言 二乘二取二系統(tǒng)的兩套計(jì)算機(jī)系統(tǒng)各有兩個(gè)CPU,并且所有結(jié)構(gòu)和配件完...
基于FPGA的級(jí)聯(lián)結(jié)構(gòu)FFT處理器的優(yōu)化設(shè)計(jì)
基于FPGA的級(jí)聯(lián)結(jié)構(gòu)FFT處理器的優(yōu)化設(shè)計(jì) 0 引 言 數(shù)字信號(hào)處理主要研究采用數(shù)字序列或符號(hào)序列表示信號(hào),并用數(shù)字計(jì)算方法對(duì)這些序列進(jìn)行...
基于FPGA的SoftSerdes設(shè)計(jì)與實(shí)現(xiàn)
基于FPGA的SoftSerdes設(shè)計(jì)與實(shí)現(xiàn) 0 引言 在高速源同步應(yīng)用中,時(shí)鐘數(shù)據(jù)恢復(fù)是基本的方法。最普遍的時(shí)鐘恢復(fù)方法是利用數(shù)字時(shí)鐘模塊...
2009-12-28 標(biāo)簽:FPGA 1111 1
利用FPGA來(lái)實(shí)現(xiàn)RC6算法的設(shè)計(jì)與研究
利用FPGA來(lái)實(shí)現(xiàn)RC6算法的設(shè)計(jì)與研究 引 言 RC6是作為AES(Advanced Encryption Standard)的候選算法提交...
2009-12-28 標(biāo)簽:FPGA 1365 0
一種基于FPGA的AGWN信號(hào)生成器的設(shè)計(jì)
一種基于FPGA的AGWN信號(hào)生成器的設(shè)計(jì) 在通信系統(tǒng)中分析計(jì)算系統(tǒng)抗噪聲性能時(shí),經(jīng)常假定信道噪聲為加性高斯型白噪聲(AGWN)。本文就是通過(guò)分析AG...
2009-12-26 標(biāo)簽:FPGA信號(hào)生成器 1247 0
基于FPGA的AGWN信號(hào)生成器 在通信系統(tǒng)中分析計(jì)算系統(tǒng)抗噪聲性能時(shí),經(jīng)常假定信道噪聲為加性高斯型白噪聲(AGWN)。本文就是通過(guò)分析AGWN的性質(zhì)...
2009-12-25 標(biāo)簽:FPGA 1026 0
FPGA在步進(jìn)電機(jī)控制中的應(yīng)用
FPGA在步進(jìn)電機(jī)控制中的應(yīng)用 步進(jìn)電機(jī)是一種將電脈沖轉(zhuǎn)化為角位移的執(zhí)行機(jī)構(gòu)。可以通過(guò)控制脈沖數(shù)來(lái)控制步進(jìn)電機(jī)的角位移量,從而達(dá)到準(zhǔn)確定位的目的,同時(shí)可
2009-12-24 標(biāo)簽:FPGA步進(jìn)電機(jī) 2027 0
對(duì)基于FPGA的作戰(zhàn)系統(tǒng)時(shí)統(tǒng)的研究與設(shè)計(jì)
對(duì)基于FPGA的作戰(zhàn)系統(tǒng)時(shí)統(tǒng)的研究與設(shè)計(jì) O 引言 作戰(zhàn)系統(tǒng)時(shí)間的統(tǒng)一同步(時(shí)統(tǒng))的重要性越來(lái)越得到重視,只有保證整個(gè)系統(tǒng)處在同一時(shí)間的基準(zhǔn)上,才能實(shí)
運(yùn)動(dòng)控制和混合信號(hào)FPGA 隨著電子元件的性能和集成度不斷提高而價(jià)格卻不斷降低,電子控制單元的發(fā)展正一日千里。隨著各種技術(shù)和應(yīng)用大量涌現(xiàn),從家電領(lǐng)域到工
追新逐熱還是腳踏實(shí)地?跟上技術(shù)發(fā)展的步伐
追新逐熱還是腳踏實(shí)地?跟上技術(shù)發(fā)展的步伐 我真的需要那種技術(shù)嗎?我現(xiàn)在應(yīng)該購(gòu)買嗎?如果我不購(gòu)買,是不是就會(huì)處于劣勢(shì)?我會(huì)不會(huì)因?yàn)樽龀鲥e(cuò)誤的決定而出局
一種基于DSP+FPGA的控制系統(tǒng)方案設(shè)計(jì)
一種基于DSP+FPGA的控制系統(tǒng)方案設(shè)計(jì) 一、前言 ? 本文提到的控制系統(tǒng)控制通信設(shè)備的正常工作,是整個(gè)通信設(shè)備的重要組成部分。該控制系統(tǒng)要...
對(duì)基于FPGA的高速路由查找算法的研究 0 引言 隨著網(wǎng)絡(luò)流量的不斷增加和路由表容量的不斷增大,路由查找已經(jīng)成為制約因特網(wǎng)的主要瓶頸。盡管采...
基于ADC和FPGA脈沖信號(hào)測(cè)量的設(shè)計(jì)方案
基于ADC和FPGA脈沖信號(hào)測(cè)量的設(shè)計(jì)方案 0引言 測(cè)頻和測(cè)脈寬現(xiàn)在有多種方法。通常基于MCU的信號(hào)參數(shù)測(cè)量,由于其MCU工作頻率很低,所以...
基于FPGA的智能誤碼測(cè)試儀 ?實(shí)際工作中,常常需要誤碼儀能測(cè)試多種信道。但是目前市面上所銷售的誤碼儀大多只能測(cè)試電信部門的標(biāo)準(zhǔn)通信信道,低速以一、二
基于FPGA的空間存儲(chǔ)器糾錯(cuò)系統(tǒng)的設(shè)計(jì)研究
基于FPGA的空間存儲(chǔ)器糾錯(cuò)系統(tǒng)的設(shè)計(jì)研究 1、引言 阿爾法磁譜儀(Alpha Magnetic Spectrometer,AMS)實(shí)驗(yàn)室是...
基于DSP+FPGA的實(shí)時(shí)視頻采集系統(tǒng)設(shè)計(jì)
基于DSP+FPGA的實(shí)時(shí)視頻采集系統(tǒng)設(shè)計(jì) 0 引言 圖像是自然生物或人造物理的觀測(cè)系統(tǒng)對(duì)世界的記錄,是以物理為載體,以介質(zhì)來(lái)記錄信息的
基于ASIC+FPGA的IPv6路由器PoS接口設(shè)計(jì)
基于ASIC+FPGA的IPv6路由器PoS接口設(shè)計(jì) IP over SDH(PoS)技術(shù)是通過(guò)SDH提供的高速傳輸通道直接傳送IP分組,它位于數(shù)...
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