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標簽 > ip核
IP就是知識產(chǎn)權(quán)核或知識產(chǎn)權(quán)模塊的意思,在EDA技術(shù)開發(fā)中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導(dǎo)體產(chǎn)業(yè)的IP定義為“用于ASIC或FPGA中的預(yù)先設(shè)計好的電路功能模塊”。
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ZedBoard學(xué)習(xí)手記(二) 開發(fā)自定義AXI總線外設(shè)IP核
想要發(fā)揮ZYNQ芯片的特長,讓整個系統(tǒng)協(xié)同工作起來,就需要將PS與PL兩部分結(jié)合在一起,在Cortex-A9核和FPGA邏輯資源之間建立通信的通道,這條...
隨著網(wǎng)絡(luò)技術(shù)與通信技術(shù)的高速發(fā)展,測試儀器和測試技術(shù)發(fā)生了革命性變化,“網(wǎng)絡(luò)就是儀器”確切地概括了測試儀器間的網(wǎng)絡(luò)化發(fā)展趨勢。
本文介紹了LCD的通用驅(qū)動電路IP核設(shè)計,采用自頂向下的設(shè)計方法將其劃分為幾個主要模塊,分別介紹各個模塊的功能,用VHDL語言對其進行描述,用FPGA實...
本應(yīng)用筆記介紹了FPGA (現(xiàn)場可編程門陣列)及其如何保護系統(tǒng)的關(guān)鍵功能和知識產(chǎn)權(quán)(IP)。本文探討了IP保護的各種途徑。SHA-1質(zhì)詢-響應(yīng)認證被認為...
基于Avalon總線SHT11溫濕度傳感器自定義IP核的開發(fā)流程
本文介紹了基于Avalon總線SHT11溫濕度傳感器自定義IP核的開發(fā)流程,利用有限狀態(tài)機設(shè)計了驅(qū)動硬件邏輯,并且基于NiosII嵌入式處理器構(gòu)建了一個...
QUARTUS II中IP核的調(diào)用方法(圖文詳解)
很多人都說QUARYUSII中的IP核是收費的,不可以直接用的,其實不然,下面我以FIR濾波器的核的使用來給大家介紹IP核的使用,希望對大家有點幫助。 ...
2013-01-16 標簽:IP核QUARTUS II 7.9萬 10
基于FPGA和IP核的數(shù)碼相框的設(shè)計和實現(xiàn)
本系統(tǒng)采用經(jīng)濟型的Cyclone II FPGA芯片作為核心,基于Nios II軟核處理器,采用軟硬件結(jié)合的方式設(shè)計數(shù)碼相框并實現(xiàn)。
基于FPGA和8051單片機IP核的多功能頻率計的設(shè)計與實現(xiàn)
文中在FPGA芯片中嵌入MC8051 IP Core,作為控制核心,利用Verilog HDL語言進行編程,設(shè)計了以MC8051 IPCore為核心的控...
基于賽靈思Virtex 6的PCI Express高速采集卡設(shè)計
本文在研究PCIExpress協(xié)議標準及其接口技術(shù)的基礎(chǔ)上,設(shè)計了基于Virtex-6FPGA芯片的PCIExpress高速數(shù)據(jù)采集卡,實現(xiàn)了外部系統(tǒng)與...
玩轉(zhuǎn)賽靈思Zedboard開發(fā)板(5):基于AXI Lite總線的從設(shè)備IP設(shè)計
本小節(jié)通過使用XPS中的定制IP向?qū)?ipwiz),為已經(jīng)存在的ARM PS 系統(tǒng)添加用戶自定IP(Custom IP ),了解AXI Lite IP基...
玩轉(zhuǎn)賽靈思Zedboard開發(fā)板(4):如何使用自帶外設(shè)IP讓ARM PS訪問FPGA?
本文的目的是使用XPS為ARM PS 處理系統(tǒng)添加額外的IP。從IP Catalog 標簽添加GPIO,并與ZedBoard板子上的8個LED燈相連。當(dāng)...
基于FPGA和IP核的FIR低通濾波器的設(shè)計與實現(xiàn)
FIR(Finite Impulse Response,有限沖擊響應(yīng))數(shù)字濾波器具有穩(wěn)定性高、可以實現(xiàn)線性相位等優(yōu)點,廣泛被應(yīng)用于信號檢測與處理等領(lǐng)域。...
基于SOPC和DDS IP核的可重構(gòu)信號源設(shè)計與實現(xiàn)
SOPC(System on a Programmable Chip,片上可編程系統(tǒng))是Altera公司提出的一種靈活、高效的SOC解決方案。它將處理器...
基于SoPC系統(tǒng)的紅外解碼IP核的設(shè)計與實現(xiàn)方法研究
電子發(fā)燒友網(wǎng)核心提示:本文主要介紹了紅外解碼IP核在SoPC系統(tǒng)中的設(shè)計與實現(xiàn)方法,重點研究紅外系統(tǒng)的數(shù)據(jù)編碼和傳輸機制、紅外解碼電路的HDL設(shè)計、IP...
SoPC應(yīng)用設(shè)計的PLD開發(fā)工具要求詳解
電子發(fā)燒友網(wǎng)核心提示:對SoPC的開發(fā)而言,PLD工具是必不可少的。PLD開發(fā)工具必須進一步發(fā)展,從而與技術(shù)進步和EDA產(chǎn)業(yè)的發(fā)展相適應(yīng)。器件的復(fù)雜度在...
xilinx IP建立向?qū)?chuàng)建的目錄和文件的作用分析
電子發(fā)燒友網(wǎng)核心提示:xilinx IP建立向?qū)?chuàng)建的目錄和文件都是做什么的?這是由錯誤ERROR:HDLCompiler:Instantiating ...
基于IP核(IP core)技術(shù)的SoC設(shè)計
1 概述 隨著集成電路(Integrated Circuit,IC)設(shè)計技術(shù)和工藝水平進入超深亞微米,集成電路規(guī)模越來越大,芯片設(shè)計規(guī)模和設(shè)計復(fù)雜度也急...
從Multicore到Many-Core:體系結(jié)構(gòu)和經(jīng)驗
您可能已經(jīng)習(xí)慣了芯片系統(tǒng)(SoC)的multicore處理器這一概念,而現(xiàn)實卻總是在不斷變化。8月份舉行的Hot Chips大會研討中,已經(jīng)清楚的表明m...
系統(tǒng)設(shè)計工程師不可不知的DRAM控制器核心結(jié)論
電子發(fā)燒友網(wǎng)核心提示: DRAM控制器藏在您的系統(tǒng)核心芯片系統(tǒng)(SoC)中,可能有兩個,甚至是四個。有一些精心制作的邏輯小模塊,用于連接SoC內(nèi)部和外部...
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