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標(biāo)簽 > lvpecl
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在選擇LVTTL33或LVCMOS33標(biāo)準(zhǔn)的情況下,V5輸出是否正常
標(biāo)簽:LVPECL 4302 1
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LVPECL驅(qū)動(dòng)器終端設(shè)計(jì)介紹
標(biāo)簽:射頻微波LVPECL 2797 5
請問FPGA管腳是否具有電平判決功能將輸入的模擬時(shí)鐘信號判決為數(shù)字時(shí)鐘信號?
標(biāo)簽:FPGAlvdsLVPECL 2470 1
請教關(guān)于ADCMP553中VCCO-2.0V的問題
標(biāo)簽:LVPECL 2407 0
通過數(shù)字控制和模擬控制延遲輸入信號的SY89296L可編程延遲線評估板
標(biāo)簽:可編程LVPECL 2160 0
AD9510 OUT5和OUT6無論如何配置,始終沒有信號輸出
標(biāo)簽:LVPECL 2137 5
LVPECL終端的設(shè)計(jì)考慮因素有哪些?
標(biāo)簽:終端LVPECL 1852 1
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請教關(guān)于 6350評估板(6300/6301)上時(shí)鐘耦合連接的問題
標(biāo)簽:LVPECL 1809 2
NB4N441MNG是一款基于精密時(shí)鐘PLL的合成器,可產(chǎn)生選擇差分LVPECL時(shí)鐘輸出頻率
標(biāo)簽:pllSONETLVPECL 1723 0
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請問AD9739A的時(shí)鐘驅(qū)動(dòng)能否使用Lvpecl標(biāo)準(zhǔn)?
標(biāo)簽:IBISLVPECL 1652 4
請問LTC5586的本振端口能否直接對接LVPECL信號?
標(biāo)簽:LVPECL 1438 2
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如何將Virtex 5 LVPECL_25連接到另一個(gè)設(shè)備的3.3v lvpecl?
標(biāo)簽:LVPECLVirtex 1362 7
如何在LVPECL、VML、CML、LVDS和子LVDS接口之間轉(zhuǎn)換
標(biāo)簽:lvdsLVPECL 852 0
AD9680時(shí)鐘為差分LVPECL的話,交流耦合如何接入呢?
標(biāo)簽:LVPECLad9680 501 0
可否直接使用LVPECL輸出的有源晶振交流耦合至AD的時(shí)鐘引腳?
標(biāo)簽:有源晶振LVPECL 499 0
如果ad9680的clk和sysref信號采用lvpecl格式輸入,交流耦合的話前端網(wǎng)絡(luò)如何設(shè)計(jì)?
標(biāo)簽:LVPECL交流耦合ad9680 455 0
ecl差分接入的0.8v擺幅是否可以驅(qū)動(dòng)ad10242,lvpecl電平是否可以滿足標(biāo)準(zhǔn)?
標(biāo)簽:ECLLVPECL 397 0
使用Lvpecl電平能夠驅(qū)動(dòng)AD9739A的時(shí)鐘端嗎?
標(biāo)簽:時(shí)鐘LVPECL 376 1
在datasheet上看到LMK04828支持LCPECL,請問什么是LCPECL,LCPECL和LVPECL的區(qū)別是什么呢?
標(biāo)簽:調(diào)節(jié)器LVPECL 310 2
當(dāng)LMK00725的輸入為LVPECL電平時(shí),由于芯片輸入管腳內(nèi)部存在51KOhm上下拉,在芯片外部是否還需要增加上下拉偏置電阻呢?
標(biāo)簽:緩沖器偏置電阻LVPECL 271 2
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