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UVM是一個以SystemVerilog類庫為主體的驗證平臺開發(fā)框架，驗證工程師可以利用其可重用組件構建具有標準化層次結構和接口的功能驗證環(huán)境。

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uvm技術

UVM設計模式之狀態(tài)模式介紹

軟件設計中，F(xiàn)SM(Finite-State Machine)分為3部分：狀態(tài)（State)，事件（Event)，動作（Action)。

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2023-08-17 標簽：轉換器寄存器耦合器 5881 0

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2023-08-11 標簽：UVM 數(shù)據(jù)結構設計模式 1027 0

行為型設計模式在UVM中的應用

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2023-08-08 標簽：UVM 生成器 python 813 0

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一文詳解UVM設計模式

本篇是對UVM設計模式 ( 二 ) 參數(shù)化類、靜態(tài)變量/方法/類、單例模式、UVM_ROOT、工廠模式、UVM_FACTORY[1]中單例模式的補充，分...

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多聯(lián)機線控器顯示09是什么故障？

最近，有售后兄弟咨詢，多聯(lián)機線控器顯示09是什么故障？注意該故障不是09（零九）代碼，而是o9（區(qū)九）代碼，如下圖所示。

2023-08-02 標簽：驅動器 UVM 無刷直流機 4178 0

什么是形式驗證(Formal驗證)？Formal是怎么實現(xiàn)的呢？

相信很多人已經接觸過驗證。如我以前有篇文章所寫驗證分為IP驗證，F(xiàn)PGA驗證，SOC驗證和CPU驗證，這其中大部分是采用動態(tài)仿真(dynamic sim...

2023-07-21 標簽：fpga 仿真器 SoC芯片 1.3萬 0

編寫動態(tài)的驗證環(huán)境

作為一名DV，開發(fā)驗證環(huán)境，編寫驗證環(huán)境也算是必備基礎技能了。雖然每天都會coding，但最終寫出來的代碼，是一次性代碼，還是方法？

2023-07-17 標簽：處理器寄存器 SoC芯片 820 0

太真實了！那些你不知道的IC驗證日常

根據(jù)調查結果如下圖所示，分別列出了近幾年DE和DV的整體數(shù)量比，以及在不同規(guī)模領域內的人數(shù)比。

2023-07-13 標簽：仿真器 UVM SPEC 2280 0

RAL寄存器模型操作指南

寄存器模型操作，指的是通過寄存器模型對RTL中寄存器進行讀寫訪問，或者同步寄存器模型與RTL中寄存器的值。

2023-07-12 標簽：寄存器 RTL UVM 1372 0

寄存器模型Register Model學習筆記

UVM的寄存器模型是一組高級抽象的類，用來對DUT中具有地址映射的寄存器和存儲器進行建模。

2023-07-11 標簽：寄存器存儲器 UVM 3138 0

對驗證現(xiàn)狀的幾點思考

根據(jù)調查結果如下圖所示，分別列出了近幾年DE和DV的整體數(shù)量比，以及在不同規(guī)模領域內的人數(shù)比。整體看大部分項目中DE和DV的配比約為1:1。

2023-07-10 標簽：芯片設計 UVM SPEC 696 0

UVM環(huán)境debug的正確開啟方式

在使用UVM搭建環(huán)境時，遇到問題時，調試方式有千千萬萬，但很有必要了解下UVM庫提供了哪些內建的調試手段，可以少走彎路，大大提升效率，而不是瘋狂加各種打印消息。

2023-07-03 標簽：UVM TLM 3351 0

UVM中uvm_config_db機制背后的大功臣

本次講一下UVM中的uvm_config_db，在UVM中提供了一個內部數(shù)據(jù)庫，可以在其中存儲給定名稱下的值，之后可以由其它TB組件去檢索。

2023-06-29 標簽：UVM DUT 1952 0

有沒有辦法像debug RTL代碼一樣將UVM中變量拉到波形上看呢？

我們常用的debug UVM的方法是通過打印log實現(xiàn)。有沒有辦法像 debug RTL代碼一樣將 UVM 中變量拉到波形上看呢？答案是有的，下面讓我們...

2023-06-29 標簽：仿真器 RTL UVM 2233 0

有趣的UVM_LOG用法

在項目中，一個TB通常是很多人一起開發(fā)的，大家或多或少都會往log中打印一些信息(message)，方便自己debug。

2023-06-29 標簽：UVM 1205 0

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