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      標(biāo)簽　>　verilog

      verilog

      +關(guān)注28人關(guān)注

      Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

      文章：706個 瀏覽：111480次 帖子：931個

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      2023-09-09 標(biāo)簽：fpga仿真Verilog 2014 0

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      2023-09-05 標(biāo)簽：Verilog計數(shù)器奇偶校驗器 3260 0

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      作為邏輯工程師，在FPGA和數(shù)字IC開發(fā)和設(shè)計中，一般采用verilog，VHDL或SystemVerilog等作為硬件描述語言進行工程設(shè)計，將一張白板...

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      2023-09-01 標(biāo)簽：fpga仿真器Verilog 1604 0

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      前不久一位朋友發(fā)來一道驗證題，雖然題目不是很復(fù)雜，但是琢磨了下感覺其中需要掌握的內(nèi)容還是很多的，正所謂麻雀雖小五臟俱全。下面將對此題涉及的一些內(nèi)容進行挖...

      2023-08-31 標(biāo)簽：仿真信號Verilog 1282 0

      基于Verilog的同步FIFO的設(shè)計方法

      同步FIFO的設(shè)計主要包括讀寫地址的產(chǎn)生、數(shù)據(jù)的讀寫、以及狀態(tài)的控制。下面我們將分別介紹這三個方面的設(shè)計。

      2023-08-31 標(biāo)簽：socfifoVerilog 1110 0

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      功能需求：開發(fā)調(diào)制解調(diào)verilog程序。要求數(shù)據(jù)上行速率1.25Gbps以上。下行速率較低，100M以上即可。程序包括：發(fā)射調(diào)制（數(shù)據(jù)編碼等）、接收解...

      2023-08-30 標(biāo)簽：調(diào)制解調(diào)無線通信Verilog 846 0

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      2023-08-30 標(biāo)簽：芯片邏輯電路soc 1424 0

      二十進制編碼器及Verilog HDL描述 Verilog HDL程序的基本結(jié)構(gòu)及特點

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      節(jié)通過硬件描述語言Verilog HDL對二十進制編碼器的描述，介紹Verilog HDL程序的基本結(jié)構(gòu)及特點。

      2023-08-28 標(biāo)簽：編碼器VerilogHDL 3326 0

      IC設(shè)計的難點在哪里？

      一般來說，coding的難度并不是特別大，如果有詳細的設(shè)計文檔，以及較好的coding經(jīng)驗，完成代碼實現(xiàn)問題不大。 IC圈有一句話叫：一千個人眼中...

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      Verilog設(shè)計規(guī)范包括哪些內(nèi)容

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      本文包含以下幾方面內(nèi)容，程序設(shè)計，模塊例化、運算符，模塊設(shè)計模板 目標(biāo)：用最簡單，最簡潔的方式，設(shè)計最易讀，最高效的代碼

      2023-08-17 標(biāo)簽：寄存器IC設(shè)計Verilog 518 0

      IC設(shè)計之Verilog代碼規(guī)范

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      Verilog規(guī)范對于一個好的IC設(shè)計至關(guān)重要。

      2023-08-17 標(biāo)簽：IC設(shè)計Verilog程序 1928 0

      FPGA的Verilog代碼編寫規(guī)范

      　　注：以R起頭的是對編寫Verilog代碼的IP設(shè)計者所做的強制性規(guī)定，以G起頭的條款是建議采用的規(guī)范。每個設(shè)計者遵守本規(guī)范可鍛煉命名規(guī)范性。

      2023-08-15 標(biāo)簽：fpgaVerilogRTL 2653 0

      設(shè)計一個計數(shù)器來講解時序邏輯

      設(shè)計一個計數(shù)器來講解時序邏輯

      時序邏輯是Verilog HDL 設(shè)計中另一類重要應(yīng)用。從電路特征上看來，其特點為任意時刻的輸出不僅取決于該時刻的輸入，而且還和電路原來的狀態(tài)有關(guān)。

      2023-08-14 標(biāo)簽：fpga邏輯電路寄存器 1545 0

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        +關(guān)注
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        特性阻抗
        +關(guān)注
        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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        時鐘源
        +關(guān)注
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      • AD采樣
        AD采樣
        +關(guān)注
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