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      標(biāo)簽　>　verilog

      verilog

      +關(guān)注29人關(guān)注

      Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

      文章：708個(gè) 瀏覽：112049次 帖子：937個(gè)

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      2023-01-15 標(biāo)簽：操作系統(tǒng)Verilog代碼 1839 0

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      介紹利用自動(dòng)化綜合工具在編碼和綜合的階段完成用于HDTV芯片設(shè)計(jì)的優(yōu)化

      2012-06-15 標(biāo)簽：VerilogVerilogHDL 1775 0

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      集合中的每個(gè)網(wǎng)絡(luò)或變量稱為數(shù)組元素。未壓縮數(shù)組的每個(gè)元素的類型、數(shù)據(jù)類型和向量大小都完全相同。每個(gè)未壓縮的數(shù)組元素可以獨(dú)立于其他元素存儲；這些元素不需要...

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      2022-06-26 標(biāo)簽：fpgaVerilog 1611 0

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      以下是一個(gè)在設(shè)計(jì)中常犯的錯(cuò)誤列表這些錯(cuò)誤常使得你的設(shè)計(jì)不可靠或速度較慢為了提高你的設(shè)計(jì)性能和提高速度的可靠性你必須確定你的設(shè)計(jì)通過所有的這些檢查。

      2011-02-23 標(biāo)簽：FPGACPLD賽靈思 1580 0

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      基于Verilog HDL設(shè)計(jì)的自動(dòng)數(shù)據(jù)采集系統(tǒng)

      摘要： 介紹了一種采用硬件控制的自動(dòng)數(shù)據(jù)采集系統(tǒng)的設(shè)計(jì)方法，包括數(shù)字系統(tǒng)自頂向下的設(shè)計(jì)思路、Verilog HDL對系統(tǒng)硬件的描述和狀態(tài)機(jī)的設(shè)計(jì)以及MA...

      2009-06-20 標(biāo)簽：Veriloghdl 1445 0

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      基于FPGA和硬件描述語言Verilog的液晶顯示控制器的設(shè)

      本設(shè)計(jì)是一種基于FPGA(現(xiàn)場可編程門陣列)的液晶顯示控制器。與集成電路控制器相比，F(xiàn)PGA更加靈活，可以針對小同的液晶顯示模塊更改時(shí)序信號和顯示數(shù)據(jù)。...

      2010-07-02 標(biāo)簽：FPGAverilog 1360 0

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        Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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