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  • 基于Cyclone系列FPGA器件和UART功能實(shí)現(xiàn)誤碼率測試儀器的設(shè)計

    在通信系統(tǒng)的設(shè)計實(shí)現(xiàn)過程中,都需要測試系統(tǒng)的誤碼性能。而常見的誤碼率測試儀多數(shù)專用于測試各種標(biāo)準(zhǔn)高速信道,不便于測試實(shí)際應(yīng)用中大量的專用信道,并且價格昂貴,搭建測試平臺復(fù)雜。隨著大規(guī)模集成電路的迅速發(fā)展,F(xiàn)PGA在保持其集成度高,體積小,功耗低,性價比高特性的同時,能夠?qū)崿F(xiàn)越來越復(fù)雜設(shè)計功能,日益廣...

    1174次閱讀 · 0評論 fpga測試系統(tǒng)uart
  • 基于FPGA/CPLD器件和高級語言VB實(shí)現(xiàn)UART通信設(shè)計

    隨著計算機(jī)技術(shù)的發(fā)展和廣泛應(yīng)用,尤其是在工業(yè)控制領(lǐng)域的應(yīng)用越來越廣泛,計算機(jī)通信顯的尤為重要。串行通信雖然使設(shè)備之間的連線大為減少,但隨之帶來串/并轉(zhuǎn)換和位計數(shù)等問題,這使串行通信技術(shù)比并行通信技術(shù)更為復(fù)雜。串/并轉(zhuǎn)換可用軟件實(shí)現(xiàn),也可用硬件實(shí)現(xiàn)。...

    1076次閱讀 · 0評論 fpgacplduart
  • 采用FPGA和兼容PCI Express的SERDES實(shí)現(xiàn)可擴(kuò)展交換接口控制器的設(shè)計

    與傳統(tǒng)ASIC相比,F(xiàn)PGA和結(jié)構(gòu)化ASIC的優(yōu)勢在于重用靈活性高、上市時間快、性能佳而成本低。FPGA和專用的IP模塊可用于現(xiàn)有的商用AdvancedTCA平臺,可用來開發(fā)可擴(kuò)展的交換接口控制器(FIC),以加快產(chǎn)品開發(fā)的設(shè)計并使線卡方案具有魯棒性和成本效益。...

    1101次閱讀 · 0評論 fpga控制器接口
  • 基于FPGA器件實(shí)現(xiàn)AGC算法和系統(tǒng)的設(shè)計

    大多數(shù)接收機(jī)必須處理動態(tài)范圍很大的信號,這需要進(jìn)行增益調(diào)整,以防止過載或某級產(chǎn)生互調(diào),調(diào)整解調(diào)器的工作以優(yōu)化工作。在現(xiàn)代無線電接收裝置中??勺冊鲆娣糯笃魇请娍氐?,并且當(dāng)接收機(jī)中使用衰減器時,他們通常都是由可變電壓控制的連續(xù)衰減器??刂茟?yīng)該是平滑的并且與輸入的信號能量通常成對數(shù)關(guān)系(線性分貝)。在大多...

    1812次閱讀 · 0評論 fpga放大器接收機(jī)
  • 采用FPGA器件EP1C3T144C6芯片和VHDL實(shí)現(xiàn)頻率測量計的設(shè)計

    在現(xiàn)代社會中,電資源成為人們生活當(dāng)中不可缺少的一部分,而發(fā)電機(jī)和電動機(jī)在電力系統(tǒng)中扮演著非常重要的角色。在很多場合,需要對電機(jī)組和電網(wǎng)的頻率進(jìn)行測量。目前,頻率測量的電路系統(tǒng)很多,這里介紹一種數(shù)字電路測頻:基于FPGA的發(fā)電機(jī)組的頻率測量計。...

    2182次閱讀 · 0評論 fpga芯片數(shù)字電路
  • 基于FPGA器件實(shí)現(xiàn)多頻鍵控調(diào)制電路的設(shè)計和仿真驗(yàn)證研究

    數(shù)字信號傳輸系統(tǒng)分為基帶傳輸系統(tǒng)和頻帶傳輸系統(tǒng).頻帶傳輸系統(tǒng)也叫數(shù)字調(diào)制系統(tǒng)。數(shù)字調(diào)制信號又稱為鍵控信號,數(shù)字調(diào)制過程中處理的是數(shù)字信號,而載波有振幅、頻率和相位3個變量,且二進(jìn)制的信號只有高低電平兩個邏輯量1和0,所以調(diào)制的過程可用鍵控的方法由基帶信號對載頻信號的振幅、頻率及相位進(jìn)行調(diào)制,最基本的...

    1072次閱讀 · 0評論 fpga濾波器計數(shù)器
  • 基于FPGA和MATLAB實(shí)現(xiàn)IIR數(shù)字濾波器的設(shè)計和仿真驗(yàn)證分析

    IIR數(shù)字濾波器在很多領(lǐng)域中都有著廣闊的應(yīng)用。與FIR數(shù)字濾波器相比,IIR數(shù)字濾波器可以用較低的階數(shù)獲得較高的選擇性,而且所用存儲單元少,經(jīng)濟(jì)效率高。一個N階IIR數(shù)字濾波器的系統(tǒng)函數(shù)為:...

    3192次閱讀 · 0評論 fpgamatlab濾波器
  • 使用Altera CycloneIIEP2C35評估板實(shí)現(xiàn)UPFC控制器IP核的設(shè)計

    UPFC控制器的IP主要用來輸出3路相位分別相差2π/3的正弦波形數(shù)據(jù)和3路相位分別相差2π/3的三角載波波形數(shù)據(jù)。由于UPFC控制系統(tǒng)采用SPWM調(diào)制技術(shù),所以要求UPFC控制器IP輸出的正弦波頻率應(yīng)跟電網(wǎng)頻率保持一致,輸出的正弦波幅值和相位可以根據(jù)需要進(jìn)行調(diào)節(jié);而輸出的三角載波頻率、幅值和相位則...

    1003次閱讀 · 0評論 fpga控制器ip核
  • 使用XC9500 CPLD實(shí)現(xiàn)FPGA電路接口的方案設(shè)計

    隨著FPGA芯片密度的增加,串行PROM已不能適應(yīng)高密度的FPGA的配置。大容量的并行PROM所要求的尋址方式又不能直接與FPGA接口,這時可以采用XC9500 CPLD和PROM對高密度FPGA進(jìn)行配置。FPGA設(shè)備在線配置或電源上電時,配置邏輯會被自動清除。FPGA的PROGRAM信號必須在30...

    1156次閱讀 · 0評論 fpgacpld接口
  • 基于可編程邏輯芯片和CPU實(shí)現(xiàn)數(shù)字鎖相環(huán)頻率合成器的設(shè)計

    數(shù)字鎖相環(huán)頻率合成系統(tǒng)的工作原理是:鎖相環(huán)對高穩(wěn)定度的基準(zhǔn)頻率(通常由晶體振蕩器直接或經(jīng)分頻后提供)進(jìn)行精確鎖定,環(huán)內(nèi)串接可編程的分頻器,通過編程改變分頻器的分頻比,使環(huán)路總的分頻比為N(可通過編程改變),從而環(huán)路穩(wěn)定的輸出 N倍的基準(zhǔn)頻率,而整個程序和系統(tǒng)的控制是要由CPU來完成的。...

    1846次閱讀 · 0評論 芯片cpu可編程邏輯
  • 基于管理和組合HDL電路單元IP庫的HAD輔助設(shè)計軟件研究

    輔助設(shè)計(HAD)軟件主要是對HDL語言的電路起一個輔助設(shè)計的作用。HAD軟件的功能有兩個:管理電路單元IP庫以及生成所需外圍電路的 HDL程序。...

    1136次閱讀 · 0評論 芯片mcupld
  • 借助FPGA協(xié)同處理提升性能和降低應(yīng)用設(shè)計成本

    傳統(tǒng)的、基于通用DSP處理器并運(yùn)行由C語言開發(fā)的算法的高性能DSP平臺,正在朝著使用FPGA預(yù)處理器和/或協(xié)處理器的方向發(fā)展。這一最新發(fā)展能夠?yàn)楫a(chǎn)品提供巨大的性能、功耗和成本優(yōu)勢。...

    875次閱讀 · 0評論 處理器dspfpga
  • 采用Spartan2系列FPGA器件實(shí)現(xiàn)全數(shù)字鎖相環(huán)路的設(shè)計和仿真驗(yàn)證

    數(shù)字鎖相環(huán)路已在數(shù)字通信、無線電電子學(xué)及電力系統(tǒng)自動化等領(lǐng)域中得到了極為廣泛的應(yīng)用。傳統(tǒng)的全數(shù)字鎖相環(huán)路(DPLL)是由中、小規(guī)模TTL集成電路構(gòu)成。這類DPLL工作頻率低,可靠性較差。隨著集成電路技術(shù)的發(fā)展,不僅能夠制成頻率較高的單片集成鎖相環(huán)路,而且可以把整個系統(tǒng)集成到一個芯片上去,實(shí)現(xiàn)所謂片上...

    1503次閱讀 · 0評論 fpga鎖相環(huán)vhdl
  • CPLD芯片ATF1508AS的特點(diǎn)及實(shí)現(xiàn)高速USB通信系統(tǒng)的設(shè)計

    ATF1508AS具有上電復(fù)位特性。在上電期間,所有的I/O引腳將為三態(tài),直到VCC到達(dá)上電電壓,這樣可防止在上電期間發(fā)生總線競爭。ATF1508AS的寄存器設(shè)計成在上電時復(fù)位,從VCC上升到VRST后的微小的延時,所有的寄存器將復(fù)位到低電平,輸出狀態(tài)要根據(jù)緩沖器的極性設(shè)置。這種特性對于狀態(tài)機(jī)的初始...

    4003次閱讀 · 0評論 芯片cpldusb
  • 基于FPGA芯片HMAC_SHA1_96計算術(shù)運(yùn)算單元的硬件設(shè)計

    圖2算法的幾點(diǎn)說明:① _ipad表示補(bǔ)位后的密鑰與ipad 異或的結(jié)果,K_opad表示補(bǔ)位后的密鑰與opad異或的結(jié)果;② 次SHA1運(yùn)算包括生成W運(yùn)算;③ 由SHA1運(yùn)算輸出的結(jié)果是經(jīng)過加法處理的結(jié)果;④ 虛線部分表示圖上忽略的信息分組和相應(yīng)的SHA1運(yùn)算部分;⑤ 如果只有512bit消息,則...

    2192次閱讀 · 0評論 fpga寄存器網(wǎng)絡(luò)
  • 基于Xilinx Spartan系列FPGA和VHDL語言設(shè)計衛(wèi)星數(shù)據(jù)存儲糾錯系統(tǒng)

    空間飛器在太空環(huán)境中面臨的主要問題之一就是輻射。太空中的各種高能粒子(包括高能質(zhì)子、中子、α粒子、得離子等)具有很高的動能,通過時可能會影響半導(dǎo)體電路的邏輯狀態(tài),甚至對半導(dǎo)體材料造成永久損害。單個高能粒子對電子器件功能產(chǎn)生的影響稱之為單粒子效應(yīng)。其中,導(dǎo)致存儲內(nèi)容在‘0’、‘1’之間發(fā)生變化的單粒子...

    1092次閱讀 · 0評論 fpga存儲器vhdl
  • Altera ACEX 1K系列CPLD器件的三種配置方法的比較

    ACEX 1K系列器件是Altera公司推出的新型CPLD產(chǎn)品。該器件基于SRAM,結(jié)合查找表(LUT)和嵌入式陣列塊(EAB)提供了高密度結(jié)構(gòu),可提供10 000到100 000可用門,每個嵌入式陣列塊增加到16位寬可實(shí)現(xiàn)雙端口,RAM位增加到49125個。其多電壓引腳可以驅(qū)動2.5V、3.3V、...

    3192次閱讀 · 0評論 cpld嵌入式sram
  • 在Altera CycIone II系列FPGA中用VHDL實(shí)現(xiàn)E2PROM控制器的設(shè)計

    E2PROM存儲器存儲單元的損壞主要是由頻繁的寫操作造成的。若要解決問題,首先耍避免對同一單元進(jìn)行頻繁的擦寫,降低存儲單元損壞的可能;其次當(dāng)某些單元損壞時,讀寫控制器應(yīng)該能夠跳過這些損壞的單元,保證系統(tǒng)能繼續(xù)正常工作。本文設(shè)計的E2PROM控制器具有這兩個方面的功能。...

    1357次閱讀 · 0評論 fpga控制器vhdl
  • 基于EP9315和MAX2_EPM240實(shí)現(xiàn)輸入輸出模塊的設(shè)計

    嵌人式丁業(yè)控制系統(tǒng)的突出特點(diǎn)是在高低溫、高電磁輻射環(huán)境下的抗干擾性和可靠穩(wěn)定性。和PLC系統(tǒng)相比。其明顯的優(yōu)點(diǎn)是處理速度快、方便進(jìn)行工業(yè)以太網(wǎng)的組建、編程方便、通用性好,而且價格僅僅是PLC的幾分之一,具有很好的發(fā)展前景。本論文主要論述了以EP9315和MAX2_EPM240為核心的嵌入式輸入輸出系...

    1280次閱讀 · 0評論 cpld微處理器嵌人式
  • 基于數(shù)控振蕩器在FPGA中實(shí)現(xiàn)偽碼跟蹤算法的改進(jìn)設(shè)計

    在圖1所示跟蹤環(huán)路結(jié)構(gòu)中,為了使碼跟蹤環(huán)同時具有大跟蹤范圍和高跟蹤精度,可以采用多個具有不同相關(guān)間距的DLL,初始跟蹤采用寬相關(guān)間距,穩(wěn)定跟蹤后為了提高精度采用窄相關(guān)間距。上述改善碼跟蹤環(huán)性能的方法,都要求產(chǎn)生多個不同延時關(guān)系的偽碼序列。...

    1339次閱讀 · 0評論 fpga振蕩器通信