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將SDAccel項目遷移到Vitis 2019.2的技巧

YCqV_FPGA_EETre ? 來源:FPGA開發(fā)圈 ? 2020-06-28 10:05 ? 次閱讀

介紹

DesignLinx 及其客戶是賽靈思 SDAccel 開發(fā)環(huán)境的早期用戶。他們使用 SDAccel 開發(fā)環(huán)境,針對搭載加速軟件的亞馬遜 AWS F1 和賽靈思 Alveo 數(shù)據中心加速器卡,開發(fā)云端應用和本地應用。

結合 SDSoC 和賽靈思 SDK,SDAccel 流現(xiàn)在是 2019.2 Vitis 統(tǒng)一軟件平臺的組成部分,便于開發(fā)者針對賽靈思器件上的所有軟件任務使用統(tǒng)一平臺。下面分享來自 DesignLinx 公司高級嵌入式軟件工程師 Nathan Sullivan 所撰寫的技巧:

1. Vitis 的優(yōu)勢

Vitis 2019.2 采用經過更新的 v++ 編譯器,強化 IDE 項目組織,為嵌入式應用和數(shù)據中心應用提供統(tǒng)一的工具流。因為全部三種流程現(xiàn)在都集成在 Vitis 內部,所以無需針對不同類型的應用在 SDAccel、SDK 和 SDSoC 之間進行切換。除了 Vitis IDE 以外,通過 v++ 工具和 SDAccel 提供的 xocc/xcpp 流等生成文件,也為構建軟件提供完整的命令行流程。

2. 易于遷移

Vitis 2019.2 使用 gcc 編譯 C 語言源代碼,使用 Vivado HLS 編譯與 SDAccel 流匹配的加速內核。此外,Vitis 也使用與 SDAccel 相同的目標平臺和賽靈思運行時。這意味著新環(huán)境能夠兼容源代碼,SDAccel 項目只需少量修改或完全無需任何修改就能在 Vitis 內完成構建。在遷移源代碼時,用戶能夠使用 Vitis IDE 或 v++ 命令行工具鏈選擇性構建新項目。

3. IDE 遷移

使用 Vitis IDE 遷移項目時,只需將所有源代碼文件從 SDAccel 項目添加到新的 Vitis 項目中,最好是指向同一器件。使用右鍵菜單上的“import sources”選項能夠輕松完成這一操作。一旦源文件導入完成,必須向二進制容器添加內核函數(shù)(如同它們在原始項目中那樣),并且任何定制構建設置也需要手動復制。

4. 命令行遷移

要對使用命令行(通常是通過生成文件)構建的項目進行遷移,必須用 v++ 調用替換 xocc 調用。類似地,必須用 g++ 調用替換 xcpp 調用,即直接調用主機 c++ 編譯器。新的 v++ 工具提供的命令行選項與 SDAccel 下的 xocc 工具一樣,因此無需做其他修改。請參閱 UG1393 進一步了解 Vitis 2019.2 有關工具變化的詳細說明。

在 SDAccel 樣例生成文件中替換 XOCC 和 CXX

修改完成后,就可以使用 Vitis 工具構建之前的 SDAccel 項目:

和以往一樣構建 SDAccel 示例,但這次使用 Vitis 路徑和工具

5.結論

雖然 Vitis 2019.2 將所有賽靈思軟件工具集成在統(tǒng)一平臺上,但 SDAccel 流并沒有顯著變化,這使得遷移工作簡單易行。現(xiàn)有項目在源代碼上兼容新工具鏈,因此基本無需修改,它們就能直接獲得 Vitis 2019.2 統(tǒng)一軟件平臺提供的優(yōu)勢。

賽靈思高級合作伙伴 DesignLinx 為運行在 Vitis 和 SDAccel 平臺上的加速應用提供開發(fā)服務,同時提供云端和本地硬件部署服務。

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原文標題:將 SDAccel 項目遷移到 Vitis 2019.2 的技巧

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