對(duì)于寄存器，如果沒(méi)有明確指定其初始值，Vivado會(huì)根據(jù)其類(lèi)型（FDCE/FDRE/FDPE/FDRE）設(shè)定合適的初始值。有些工程師喜歡使用復(fù)位信號(hào)，對(duì)所有的寄存器進(jìn)行上電復(fù)位，使其在處理數(shù)據(jù)之前達(dá)到期望初始狀態(tài)。但這會(huì)有一個(gè)不利之處就是復(fù)位信號(hào)的扇出很大，從而消耗了大量的布線(xiàn)資源，甚至造成布線(xiàn)擁塞。那么能不能讓寄存器在上電之后不用通過(guò)復(fù)位就輸出期望值呢？答案是肯定的。

Xilinx也建議對(duì)于同步元件，最好設(shè)定其初始值。這里我們以最常用的寄存器為例。如果使用的是VHDL，可以采用下面的方法設(shè)定寄存器初始值，如下圖所示。

如果使用的是Verilog，可以采用下面的方法設(shè)定寄存器初始值，如下圖所示。

此外，對(duì)于Verilog，也可通過(guò)initial設(shè)定初始值，如下圖所示。

采用這種方法的好處是：綜合工具是支持的，這樣生成bit文件時(shí)這些初始值會(huì)被寫(xiě)入配置文件中，上電即可生效，避免了使用復(fù)位造成的扇出過(guò)大；同時(shí)在仿真時(shí)，也能跟實(shí)際業(yè)務(wù)相匹配。 為了驗(yàn)證這個(gè)方法是否生效，只需要打開(kāi)綜合后的.dcp，找到相應(yīng)的寄存器，在其Property窗口中查看屬性INIT的值，如下圖所示。

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