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基于Vivado下怎么找到關(guān)鍵路徑?

FPGA技術(shù)驛站 ? 來源:TeacherGaoFPGAHub ? 作者:TeacherGaoFPGAHub ? 2021-07-06 17:22 ? 次閱讀
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什么是關(guān)鍵路徑?

關(guān)鍵路徑分為兩類:一類是時序違例的路徑,主要是建立時間違例;

另一類是時序沒有違例,但邏輯級數(shù)較高的路徑。當(dāng)然,第一類路徑中可能會包含第二類路徑。

對于第一類路徑,其違例的原因無外乎邏輯延遲太大、線延遲太大或者時鐘Skew太大等??梢愿鶕?jù)具體原因?qū)ΠY下藥。對于第二類路徑,其“副作用”比較明顯:

工具犧牲了其他路徑換取了這類路徑的收斂,最終我們可能會看到時序違例的路徑反倒是那些邏輯級數(shù)很低甚至為0的路徑,而這類路徑通常已經(jīng)沒有什么優(yōu)化空間了。此時,要實現(xiàn)整個設(shè)計的時序收斂就變得捉襟見肘了。

因此,在設(shè)計早期找到這類路徑至關(guān)重要。

編輯:jq

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原文標(biāo)題:Vivado下如何找關(guān)鍵路徑?

文章出處:【微信號:Lauren_FPGA,微信公眾號:FPGA技術(shù)驛站】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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