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仿真例子工程介紹

FPGA技術(shù)江湖 ? 來源:FPGA技術(shù)江湖 ? 作者:賽靈思工程師 Ir ? 2022-06-14 11:10 ? 次閱讀
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PCIe 仿真需要Endpoint 模型和Root Port 模型協(xié)同工作。用戶一般可以采用購買BFM/VIP 來模擬對端模型也可以自己設(shè)計(jì)對端模型,更簡便的方法則是使用Xilinx 提供的模型 (Xilinx Root Port model) 。

仿真例子工程介紹

Versal 的PCIe 仿真和VU/VU+ 系列有些不一樣,在endpoint 模式下,會有兩種類型的example design, 默認(rèn)的例子 是BMD 模式,(以前的器件默認(rèn)的模式是PIO 模式 )在生成IP 后, 可以通過設(shè)置下面參數(shù)來切換產(chǎn)生的例子工程。

CONFIG.bmd_pio_mode {false}

用戶仿真的例子一般有兩個(gè)部分:

1. Root Port 模型,這個(gè)是模擬了RP 的產(chǎn)生config 讀寫,讀寫memory 空間并負(fù)責(zé)對收回來的數(shù)據(jù)進(jìn)行檢查。

2. Endpoint 用戶代碼部分,負(fù)責(zé)對收到的請求進(jìn)行回復(fù)并且發(fā)起讀寫,中斷請求。

在不同的測試間切換:

sample_tests.vh 定義了不同的測試名字,

sample_smoke_test0:

確認(rèn)device/vender ID,運(yùn)行BMD test (如果是BMD mode)

sample_smoke_test1:

確認(rèn)device/vender ID,確認(rèn)比較completion 數(shù)據(jù)。

pio_writeReadBack_test0 :

RP 模型會對每一個(gè)BAR發(fā)起一次寫操作,再發(fā)起一次讀操作,EP 收到后會發(fā)出CPLD。PR模型會對收到的CPLD 進(jìn)行檢查。RP 模型可以往EP 的特定位置寫特定的值使得EP發(fā)起讀寫或者中斷。

如果要在不同的測試間切換, 可以 TESTNAME 參數(shù),比如:

demo_tb.exe-gui -view wave.wcfg -wdb wave_isim -tclbatch isim_cmd.tcl -testplusarg TESTNAME=sample_smoke_test0

修改仿真例子:

修改提供的 example 代碼可以得到自己想要的測試。

如果需要修改 Sample_smoke_test0/1 中 ROOT PORT 對自己的設(shè)置, 可以直接修改 Sample_tests.vh 下面的代碼,比如下面的代碼實(shí)現(xiàn)的是讀取地址1 往地址1里面寫7 再讀出來的過程,實(shí)現(xiàn)的是bus master /memory /IO 的使能。請注意這里的地址是DW Address , 也就是這個(gè)地址1 實(shí)際上是地址4 (byte address) 也就是協(xié)議固定的command register。

e4bee6b2-eb6b-11ec-ba43-dac502259ad0.jpg

可以復(fù)制以上代碼 修改地址數(shù)據(jù)和byte enable 來實(shí)現(xiàn)對不同寄存器的操作。

如果需要修改對于EP側(cè) 配置寄存器的直接控制,可以修改下面的代碼,填入不同的地址實(shí)現(xiàn)不同寄存器的讀寫。

e4d4f736-eb6b-11ec-ba43-dac502259ad0.jpg

如果使用其他的分支,修改的方式類似。

RP 模型還提供了豐富的功能來實(shí)現(xiàn)對PCIe EP 配置空間的操作和memory 的讀寫操作。這些操作大部分都用通過一些task 在pci_exp_usrapp_tx / pci_exp_usrapp_rx 中實(shí)現(xiàn)。比如下面的 BAR_PROGRAM 任務(wù) 就是把對BAR 的讀寫以及控制的過程實(shí)現(xiàn)了一遍。

由于BAR 讀寫是所有memory 請求的基礎(chǔ),大部分的測試都會用到,所以一般就可以直接修改這個(gè)task 來豐富測試的內(nèi)容。比如可以直接在這個(gè) task 內(nèi)部 ,復(fù)制下面的語句, 把地址修改為自己需要的配置地址來實(shí)現(xiàn)對其他配置寄存器的操作。最常見的修改就是修改下面的語句把 32‘h00000003 修改為32‘h00000007 使得 bus master 被打開。這樣 EP 就具備了發(fā)起讀寫操作的能力。需要修改其他寄存器也是一樣的道理, 請注意這里的地址區(qū)別與上面的DW address 而是byte address。(04 表示command register)

e4fe093c-eb6b-11ec-ba43-dac502259ad0.jpg

其他的修改也是類似。

審核編輯 :李倩
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原文標(biāo)題:開發(fā)者分享|Versal PCIe Example Design 仿真技巧 1

文章出處:【微信號:HXSLH1010101010,微信公眾號:FPGA技術(shù)江湖】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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