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一文詳解Vivado時(shí)序約束

FPGA設(shè)計(jì)論壇 ? 來源:CSDN技術(shù)社區(qū) ? 2025-03-24 09:44 ? 次閱讀

一、概覽

e3ef9d9a-0561-11f0-9310-92fbcf53809c.png

二、創(chuàng)建約束

Vivado的時(shí)序約束是保存在xdc文件中,添加或創(chuàng)建設(shè)計(jì)的工程源文件后,需要?jiǎng)?chuàng)建xdc文件設(shè)置時(shí)序約束。時(shí)序約束文件可以直接創(chuàng)建或添加已存在的約束文件,創(chuàng)建約束文件有兩種方式:Constraints Wizard和Edit Timing Constraints,在綜合后或?qū)崿F(xiàn)后都可以進(jìn)行創(chuàng)建。

2.1 Constraints Wizard

Constraints Wizard流程下將會(huì)以引導(dǎo)式的方式幫助用戶設(shè)置約束,以綜合后的設(shè)置為例,在Flow Navigator窗口中,進(jìn)入Synthesis->Open Synthesized->Constraints Wizard

e401298e-0561-11f0-9310-92fbcf53809c.png

點(diǎn)擊Constraints Wizard,彈出彈框提示無約束文件,選擇Define Target

e41f5b0c-0561-11f0-9310-92fbcf53809c.png

選擇Create File創(chuàng)建約束文件

e43047aa-0561-11f0-9310-92fbcf53809c.png

File name設(shè)置約束文件名字,F(xiàn)ile location設(shè)置約束文件保存路徑,默認(rèn)即可

e455e348-0561-11f0-9310-92fbcf53809c.png

勾選Target下的方框后,右下角的OK 高亮,點(diǎn)擊OK。

e45d6dc0-0561-11f0-9310-92fbcf53809c.png

在Source窗口中查看創(chuàng)建的約束文件,包含了timing_set.xdc文件,說明創(chuàng)建成功

e4813c82-0561-11f0-9310-92fbcf53809c.png

2.2 Edit Timing Constraints

Edit Timing Constraints和Constraints Wizard處于相同的標(biāo)題下

e48bd6b0-0561-11f0-9310-92fbcf53809c.png

點(diǎn)擊Edit Timing Constraints,進(jìn)入設(shè)置界面,左側(cè)中顯示可設(shè)置的約束類型,默認(rèn)是選擇Create Clock,點(diǎn)擊紅框中的“+”號(hào),進(jìn)入添加界面

e4a51ea4-0561-11f0-9310-92fbcf53809c.png

輸入Clock name,設(shè)置Source object和時(shí)鐘周期相關(guān)值,點(diǎn)擊OK,

e4b32e54-0561-11f0-9310-92fbcf53809c.png

點(diǎn)擊保存圖標(biāo)后按ctrl+s,彈出保存框,點(diǎn)擊OK

e4d70324-0561-11f0-9310-92fbcf53809c.png

設(shè)置保存的約束文件名后,點(diǎn)擊OK

e4e1e24e-0561-11f0-9310-92fbcf53809c.png

在All Constraints中將出現(xiàn)剛剛設(shè)置的約束

e4fca1a6-0561-11f0-9310-92fbcf53809c.png

2.3 Constraints目錄下創(chuàng)建

Source窗口下進(jìn)入Constraints中,鼠標(biāo)點(diǎn)擊右鍵彈出彈窗,進(jìn)入Add sources中可以創(chuàng)建或添加約束文件

e50cffd8-0561-11f0-9310-92fbcf53809c.png

點(diǎn)擊Next

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選擇Create File

e53b62c4-0561-11f0-9310-92fbcf53809c.png

輸入約束文件名,點(diǎn)擊OK保存成功

e56038b0-0561-11f0-9310-92fbcf53809c.png

2.4 Sources窗口“+”創(chuàng)建

在Source窗口下,有一個(gè)“+”圖標(biāo),點(diǎn)擊該圖標(biāo)

e56cd700-0561-11f0-9310-92fbcf53809c.png

進(jìn)入Add Sources窗口,剩余操作和2.3 Constraints目錄下創(chuàng)建相同

e5934052-0561-11f0-9310-92fbcf53809c.png

2.5 菜單欄File中創(chuàng)建

在菜單欄File中的列表中,選擇“Add Sources”

e5ae4938-0561-11f0-9310-92fbcf53809c.png

進(jìn)入Add Sources界面

e5d5dde0-0561-11f0-9310-92fbcf53809c.png

選擇Create File,后續(xù)的操作和2.3節(jié)相同

e5f47dae-0561-11f0-9310-92fbcf53809c.png

三、設(shè)置約束

3.1 約束類型

vivado支持的約束有5大類,具體見下圖

e603f2f2-0561-11f0-9310-92fbcf53809c.png

在timing constraints中顯示了可設(shè)置的約束,左側(cè)點(diǎn)擊要設(shè)置的約束類型,右側(cè)序號(hào)2位置處自動(dòng)顯示該類約束,此時(shí)再點(diǎn)擊3,自動(dòng)進(jìn)入創(chuàng)建約束的窗口中。

e631dd7a-0561-11f0-9310-92fbcf53809c.png

進(jìn)入set system jitter窗口

e63e2706-0561-11f0-9310-92fbcf53809c.png

3.2 約束命令

各種約束的使用格式可參見Language Templates,在Language templates的模板templates中,XDC中Timing Constraints選擇需要設(shè)置的約束,右側(cè)Preview自動(dòng)顯示約束的格式

e65fe224-0561-11f0-9310-92fbcf53809c.png

原文鏈接:https://blog.csdn.net/zyp626/article/details/132866676

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原文標(biāo)題:Vivado之時(shí)序約束操作大全

文章出處:【微信號(hào):gh_9d70b445f494,微信公眾號(hào):FPGA設(shè)計(jì)論壇】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。

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