如何在SDAccel開(kāi)發(fā)環(huán)境中加速RTL加速器與軟件框架的集成
SDAccel? 是 OpenCL? 應(yīng)用的完整開(kāi)發(fā)環(huán)境,主要面向 Xilinx? FPGA 加速開(kāi)發(fā)板。它可實(shí)現(xiàn)在不需要硬件設(shè)計(jì)經(jīng)驗(yàn)的情況下對(duì)系統(tǒng)內(nèi)處理器和 FPGA 器件進(jìn)行同步。視頻討論了SDAccel設(shè)計(jì)環(huán)境如何加速RTL加速器與軟件框架的集成，并實(shí)現(xiàn)多個(gè)IP的快速集成，按鈕驗(yàn)證，性能調(diào)整以及設(shè)備之間的可移植性。
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