數(shù)字設(shè)計(jì)FPGA應(yīng)用：阻塞與非阻塞
阻塞賦值即賦值沒(méi)完成，后邊的語(yǔ)句將無(wú)法執(zhí)行，非阻塞剛好與其相反，即賦值完不完成并不阻礙后續(xù)程序的執(zhí)行，所以我們常說(shuō)非阻塞賦值的對(duì)象并未立馬得到新值，如果從時(shí)序來(lái)看，被賦值對(duì)象會(huì)比賦值對(duì)象差一個(gè)時(shí)鐘周期。
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