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• Allegro X 23.11 版本更新 I PCB 設(shè)計：與器件關(guān)聯(lián)的動態(tài)禁布區(qū)2024-08-03 08:12

  

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  allegro PCB設(shè)計 器件 1213瀏覽量

• Allegro X 23.11 版本更新 I PCB 設(shè)計：圖紙打印和時序調(diào)整2024-07-27 08:12

  

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  allegro PCB設(shè)計 時序調(diào)整 1110瀏覽量

• 同軸電纜中差分信號的設(shè)計要點2024-07-20 08:13

  

  同軸電纜是在無線電頻率下長距離傳輸信號的主流選擇。同軸電纜有頻帶限制，因此一般不用于傳輸數(shù)字數(shù)據(jù)或脈沖信號。不過，它們可用于傳輸特殊模擬應(yīng)用中的信號，包括向接收器提供數(shù)據(jù)的調(diào)制信號。同軸電纜還可以用于傳輸差分模擬信號。在模擬應(yīng)用中使用差分信號并不常見；差分信號可能會用于特殊的測量應(yīng)用，帶有定制的差分驅(qū)動器或差分運算放大器。盡管如此，普通器件組合依然支持差分信

  同軸電纜 差分信號 無線電 1742瀏覽量

• Allegro X 23.11 版本更新 I PCB 設(shè)計：3DX 新特性2024-07-20 08:12

  

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  3d視圖 allegro PCB設(shè)計 1669瀏覽量

• PDN 元件對阻抗的影響2024-07-13 08:13

  

  在數(shù)字系統(tǒng)中，PCB的電源分配網(wǎng)絡(luò)(powerdeliverynetwork，即PDN)需要在較寬的頻率范圍內(nèi)具有較低的阻抗值，以確保在數(shù)字器件運行時，電壓波動能保持在較低水平。決定PDN阻抗的因素有很多，不單單是數(shù)字處理器中用于穩(wěn)定功率輸出的電容器。在工作頻率達到GHz級別的先進系統(tǒng)中，PDN阻抗不僅受到電容器的影響，還有很多因素會決定PDN阻抗，即便在非

  pcb PCB PDN 數(shù)字系統(tǒng) 阻抗 1312瀏覽量

• 電路仿真和PCB設(shè)計軟件2024-07-13 08:12

  

  關(guān)鍵要點電路仿真軟件和PCB設(shè)計軟件在PCB設(shè)計過程中發(fā)揮著互補作用，為工程師提供設(shè)計、仿真、驗證和優(yōu)化電子電路的工具。有效的仿真分析有助于減少開發(fā)所需的設(shè)計、制造和測試迭代次數(shù)，確保電路設(shè)計在板制造前滿足性能和操作目標。PSpice仿真工具和OrCADXPCB設(shè)計軟件是Cadence工具套件的兩個組成部分，用于設(shè)計和仿真電子電路和PCB。OrCADXCap

  PCB設(shè)計 電路仿真 軟件 2886瀏覽量

• 氮化鎵（GaN）的最新技術(shù)進展2024-07-06 08:13

  

  本文要點氮化鎵是一種晶體半導體，能夠承受更高的電壓。氮化鎵器件的開關(guān)速度更快、熱導率更高、導通電阻更低且擊穿強度更高。氮化鎵技術(shù)可實現(xiàn)高功率密度和更小的磁性。氮化鎵(GaN)和碳化硅(SiC)是兩種寬禁帶半導體，徹底改變了傳統(tǒng)電力電子技術(shù)。氮化鎵技術(shù)使移動設(shè)備的快速充電成為可能。氮化鎵器件經(jīng)常用于一些轉(zhuǎn)換器和驅(qū)動器應(yīng)用氮化鎵是一種晶體半導體，能夠承受更高的電

  GaN 半導體 快速充電 氮化鎵 1527瀏覽量

• 使用 Allegro X AI 加速PCB設(shè)計2024-07-06 08:13

  

  關(guān)鍵要點AllegroXAI利用AI算法優(yōu)化信號完整性、熱影響和電源完整性布局，縮短了元件放置和電源平面生成所需的時間。通過自動布線關(guān)鍵信號網(wǎng)并遵守電氣和制造限制，AllegroXAI提高了布局精度。OrCADX集成了AllegroX強大的AI功能，提供云平臺可擴展性和實時數(shù)據(jù)管理。為電源和接地層選擇層，以自動合成電源和接地層。電子設(shè)計自動化（EDA）工具對

  allegro PCB設(shè)計 人工智能 電源 5219瀏覽量

• 0706線下活動 I DDR4/DDR5內(nèi)存技術(shù)高速信號專題設(shè)計技術(shù)交流活動2024-07-06 08:12

  

  01活動主題DDR4/DDR5內(nèi)存技術(shù)高速信號專題設(shè)計技術(shù)交流活動時間：2024年7月6日（本周六）10：00地點：深圳市南山區(qū)科技南十二路曙光大廈1002（深圳地鐵1號線，高新園地鐵站D出口200米）02活動內(nèi)容1、本次活動重點分析DDR4/DDR5的內(nèi)存控制原理，內(nèi)存控制技術(shù)中的讀寫原理方法、原理圖設(shè)計和關(guān)鍵的信號特征。講解DDR4/DDR5的原理圖設(shè)計

  DDR4 DDR5 內(nèi)存 高速信號 681瀏覽量

• 7月15日開班啦！ | Cadence 高速項目設(shè)計暑假速成班2024-07-06 08:12

  

  一年一度暑假季高考結(jié)束，暑假已至！在這一年一度的暑假季里，機遇與成長相伴。李老師滿懷熱忱，計劃安排一次Cadence高速項目設(shè)計速成班，本次培訓將帶領(lǐng)大家完成高速實例項目設(shè)計。課程介紹本項目基于Cadence最新的AllegroX23.11版本設(shè)計仿真工具，采用實例項目的方式手把手教學。包含OrCADXCapture的原理圖設(shè)計、PCB的封裝庫設(shè)計、各種異形

  Cadence pcb PCB 項目設(shè)計 604瀏覽量