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FPGA研究院

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FPGA定點(diǎn)和浮點(diǎn)數(shù)學(xué)運(yùn)算實(shí)例對比

在創(chuàng)建 RTL 示例時(shí),經(jīng)常使用 VHDL 2008 附帶的 VHDL 包。它提供了出色的功能,可以....
的頭像 FPGA研究院 發(fā)表于 06-23 09:53 ?266次閱讀
FPGA定點(diǎn)和浮點(diǎn)數(shù)學(xué)運(yùn)算實(shí)例對比

Altera FPGA與高速ADS4249和DAC3482的LVDS接口設(shè)計(jì)

引言: 本文以TI的ADS4249(ADC)和DAC3482(DAC)之間的接口為例,介紹Alter....
的頭像 FPGA研究院 發(fā)表于 06-19 10:05 ?562次閱讀
Altera FPGA與高速ADS4249和DAC3482的LVDS接口設(shè)計(jì)

FPGA使用Cordic算法求解角度正余弦值

在進(jìn)行坐標(biāo)變換的時(shí)候,需要計(jì)算角度的正余弦值,而在FPGA中是不能直接進(jìn)行求解的,需要采用其它的方式....
的頭像 FPGA研究院 發(fā)表于 06-19 09:54 ?426次閱讀
FPGA使用Cordic算法求解角度正余弦值

FPGA與高速ADC接口簡介

本文介紹FPGA與高速ADC接口方式和標(biāo)準(zhǔn)以及JESD204與FPGA高速串行接口。
的頭像 FPGA研究院 發(fā)表于 06-12 14:18 ?743次閱讀
FPGA與高速ADC接口簡介

詳解I2S時(shí)序

01 整體概括 最近調(diào)試了一款音頻采集芯片wm8731,包含兩路音頻輸入(ADC)和一路音頻輸出(D....
的頭像 FPGA研究院 發(fā)表于 11-26 17:16 ?2214次閱讀
詳解I2S時(shí)序

?ISP算法及架構(gòu)分析介紹

一、ISP算法及架構(gòu)分析介紹 ISP即Image Signal Processor,是一種圖像處理架....
的頭像 FPGA研究院 發(fā)表于 11-26 10:05 ?1710次閱讀
?ISP算法及架構(gòu)分析介紹

找到精通大功率PCB設(shè)計(jì)的工程師真的很難嗎

在電子工程的世界里,大功率PCB工程師就像是隱藏在幕后的超級英雄,他們用電路板作為畫布,以電子元件為....
的頭像 FPGA研究院 發(fā)表于 11-18 10:52 ?846次閱讀

淺析FPGA的重要用途

FPGA 允許在單個(gè)芯片中實(shí)現(xiàn)大量數(shù)字邏輯,其運(yùn)行速度相對較高,并且只需很少或不需要在 CPU 內(nèi)核....
的頭像 FPGA研究院 發(fā)表于 11-05 15:49 ?2023次閱讀
淺析FPGA的重要用途

Xilinx 7系列FPGA PCIe Gen3的應(yīng)用接口及特性

Xilinx7系列FPGA集成了新一代PCI Express集成塊,支持8.0Gb/s數(shù)據(jù)速率的PC....
的頭像 FPGA研究院 發(fā)表于 11-05 15:45 ?2896次閱讀
Xilinx 7系列FPGA PCIe Gen3的應(yīng)用接口及特性

編寫高效Testbench的指南和示例

Testbench是驗(yàn)證HDL設(shè)計(jì)的主要手段,本文提供了布局和構(gòu)建高效Testbench的指南以及示....
的頭像 FPGA研究院 發(fā)表于 10-29 16:14 ?1699次閱讀
編寫高效Testbench的指南和示例

基于FPGA的計(jì)算器設(shè)計(jì)

本文通過FPGA實(shí)現(xiàn)8位十進(jìn)制數(shù)的加、減、乘、除運(yùn)算,通過矩陣鍵盤輸入數(shù)據(jù)和運(yùn)算符,矩陣鍵盤的布局圖....
的頭像 FPGA研究院 發(fā)表于 10-24 14:28 ?1224次閱讀
基于FPGA的計(jì)算器設(shè)計(jì)

基于FPGA的UART串口接收模塊設(shè)計(jì)

串行通信指利用一條數(shù)據(jù)線將資料一位位的順序傳輸。
的頭像 FPGA研究院 發(fā)表于 10-24 14:24 ?1812次閱讀
基于FPGA的UART串口接收模塊設(shè)計(jì)

UART通信協(xié)議介紹和數(shù)據(jù)傳輸工作流程

UART是一種通用串行數(shù)據(jù)總線,用于異步通信。該總線雙向通信,可實(shí)現(xiàn)全雙工傳輸和接收。UART通常用....
的頭像 FPGA研究院 發(fā)表于 10-24 14:20 ?2160次閱讀
UART通信協(xié)議介紹和數(shù)據(jù)傳輸工作流程

DS1302芯片與FPGA之間SPI通信原理

本文通過以DS1302芯片為基礎(chǔ),介紹該芯片與FPGA之間SPI通信原理,詳細(xì)描述硬件設(shè)計(jì)原理及FP....
的頭像 FPGA研究院 發(fā)表于 10-24 14:16 ?1457次閱讀
DS1302芯片與FPGA之間SPI通信原理

一個(gè)FPGA布局布線的報(bào)錯(cuò)問題

從最初學(xué)FPGA到現(xiàn)在,遇到過太多bug,但都沒有寫過博客記錄,因?yàn)槎鄶?shù)問題都比較簡單且網(wǎng)上有比較好....
的頭像 FPGA研究院 發(fā)表于 10-24 14:05 ?1082次閱讀
一個(gè)FPGA布局布線的報(bào)錯(cuò)問題

怎么在JAVA中確定線性池大小

在JAVA中確定線性池大小,分別介紹CPU密集型任務(wù)和I/O密集型任務(wù)及其處理方法。
的頭像 FPGA研究院 發(fā)表于 10-24 14:02 ?444次閱讀

I2C協(xié)議的基礎(chǔ)知識

本文從I2C協(xié)議的概述開始,描述協(xié)議的歷史、不同速度模式、物理層和數(shù)據(jù)幀結(jié)構(gòu),最后介紹I2C混合電壓....
的頭像 FPGA研究院 發(fā)表于 10-22 15:51 ?1946次閱讀
I2C協(xié)議的基礎(chǔ)知識

深度解析FPGA中的時(shí)序約束

建立時(shí)間和保持時(shí)間是FPGA時(shí)序約束中兩個(gè)最基本的概念,同樣在芯片電路時(shí)序分析中也存在。
的頭像 FPGA研究院 發(fā)表于 08-06 11:40 ?1322次閱讀
深度解析FPGA中的時(shí)序約束

I2C總線協(xié)議的基礎(chǔ)知識

串口是傳感器、外設(shè)常用的接口,在低速器件中可以通過串口傳輸數(shù)據(jù)。高速復(fù)雜的器件,往往內(nèi)部存在很多寄存....
的頭像 FPGA研究院 發(fā)表于 08-06 11:36 ?1567次閱讀
I2C總線協(xié)議的基礎(chǔ)知識

FPGA設(shè)計(jì)面臨的挑戰(zhàn)和解決方案

設(shè)計(jì)可靠的可編程邏輯門陣列(FPGA)對于不容故障的系統(tǒng)來說是一項(xiàng)具有挑戰(zhàn)性的任務(wù)。本文介紹FPGA....
的頭像 FPGA研究院 發(fā)表于 08-06 11:33 ?921次閱讀

FPGA的內(nèi)部架構(gòu)和設(shè)計(jì)流程

之前大多數(shù)軟件都是與它們各自的硬件一起發(fā)布,沒有辦法對其進(jìn)行更改。但隨著技術(shù)的成熟,制造商找到了在現(xiàn)....
的頭像 FPGA研究院 發(fā)表于 08-06 11:31 ?1610次閱讀
FPGA的內(nèi)部架構(gòu)和設(shè)計(jì)流程

6kW大功率逆變器PCB設(shè)計(jì)

在設(shè)計(jì)6kW大功率逆變器的PCB時(shí),變壓器的布局(layout)是至關(guān)重要的一部分,直接影響到系統(tǒng)的....
的頭像 FPGA研究院 發(fā)表于 08-06 11:27 ?1863次閱讀
6kW大功率逆變器PCB設(shè)計(jì)

如何在FPGA中實(shí)現(xiàn)隨機(jī)數(shù)發(fā)生器

分享如何在Xilinx Breadboardable Spartan-7 FPGA, CMOD S7....
的頭像 FPGA研究院 發(fā)表于 08-06 11:20 ?1146次閱讀
如何在FPGA中實(shí)現(xiàn)隨機(jī)數(shù)發(fā)生器

LCD屏和觸摸屏的PCB設(shè)計(jì)

液晶顯示屏(LCD)和觸摸屏技術(shù)已經(jīng)成為各種電子設(shè)備的核心組成部分,從智能手機(jī)到電視和醫(yī)療設(shè)備。在這....
的頭像 FPGA研究院 發(fā)表于 07-18 11:17 ?3139次閱讀
LCD屏和觸摸屏的PCB設(shè)計(jì)

FPGA高速收發(fā)器的來源

本文主要講解的是FPGA高速收發(fā)器的來源,著重從三個(gè)方面解析,可能部分理解會存在有錯(cuò)誤,想要不一致的....
的頭像 FPGA研究院 發(fā)表于 07-18 11:13 ?789次閱讀
FPGA高速收發(fā)器的來源

FPGA如何估算分析功耗

FPGA的功耗由4部分組成:上電功耗、配置功耗、靜態(tài)功耗和動(dòng)態(tài)功耗。一般的FPGA都具有這4種功耗,....
的頭像 FPGA研究院 發(fā)表于 07-18 11:11 ?2482次閱讀
FPGA如何估算分析功耗

基于fpga的ds1337讀寫控制

前文對ds1337的功能做了詳細(xì)講解,F(xiàn)PGA控制不需要使用中斷功能,并且默認(rèn)晶體振蕩器處于工作狀態(tài)....
的頭像 FPGA研究院 發(fā)表于 07-17 11:33 ?946次閱讀
基于fpga的ds1337讀寫控制

光口與協(xié)議的區(qū)別

01光口與協(xié)議的區(qū)別? 前段時(shí)間開始學(xué)習(xí)高速接口的時(shí)候,會經(jīng)常使用光口收發(fā)數(shù)據(jù),不知道有沒有人在沒有....
的頭像 FPGA研究院 發(fā)表于 06-04 09:29 ?2182次閱讀
光口與協(xié)議的區(qū)別

FPGA實(shí)現(xiàn)IIC協(xié)議的設(shè)計(jì)

今天給大家?guī)淼氖荌IC通信,IIC協(xié)議應(yīng)用非常廣泛,例如與MPU6050進(jìn)行通信,配置OV5640....
的頭像 FPGA研究院 發(fā)表于 03-04 10:49 ?1678次閱讀
FPGA實(shí)現(xiàn)IIC協(xié)議的設(shè)計(jì)

異步復(fù)位異步釋放會有什么問題?FPGA異步復(fù)位為什么要同步釋放呢?

一般來說,復(fù)位信號有效后會保持比較長一段時(shí)間,確保 register 被復(fù)位完成。但是復(fù)位信號釋放時(shí)....
的頭像 FPGA研究院 發(fā)表于 01-24 09:32 ?2136次閱讀
異步復(fù)位異步釋放會有什么問題?FPGA異步復(fù)位為什么要同步釋放呢?