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SN65LVDT101 2Gbps LVDS/LVPECL/CML 至 LVPECL 中繼器/轉(zhuǎn)換器

數(shù)據(jù):

描述

SN65LVDS100,SN65LVDT100,SN65LVDS101和SN65LVDT101是連接為中繼器的高速差分接收器和驅(qū)動(dòng)器。接收器接受低壓差分信號(hào)(LVDS),正射極耦合邏輯(PECL)或電流模??式邏輯(CML)輸入信號(hào),速率高達(dá)2 Gbps,并將其重復(fù)為L(zhǎng)VDS或PECL輸出信號(hào)。通過(guò)器件的信號(hào)路徑是差分的,用于低輻射發(fā)射和最小的附加抖動(dòng)。

SN65LVDS100和SN65LVDT100的輸出是TIA /EIA-644-A定義的LVDS電平。 SN65LVDS101和SN65LVDT101的輸出與3.3V PECL電平兼容。兩個(gè)驅(qū)動(dòng)差分傳輸線的標(biāo)稱(chēng)值均為100Ω。

SN65LVDT100和SN65LVDT101包含一個(gè)110Ω差分線路終端電阻,可減少電路板空間,減少元件數(shù)量,并縮短最短的短截線長(zhǎng)度。它們不包括SN65LVDS100和SN65LVDS101中的V BB 電壓參考。 V BB 提供低于V CC 的電壓基準(zhǔn),通常為1.35 V,用于接收單端輸入信號(hào),對(duì)于單端3.3 V PECL輸入特別有用。當(dāng)不使用V BB 時(shí),它應(yīng)該是未連接或打開(kāi)的。

所有器件的特點(diǎn)是在-40°C至85°C的溫度范圍內(nèi)工作。

特性

  • 設(shè)計(jì)用于≥2Gbps的信令速率
  • 總抖動(dòng)< 65 ps
  • MC100EP16的低功耗替代方案
  • 低100 ps(最大)器件間偏斜
  • 25 mV接收器輸入閾值滯后
    超過(guò)0 V至4 V輸入電壓范圍
  • 輸入電氣兼容LVPECL,
    CML和LVDS信號(hào)電平
  • 3.3 V電源操作
  • LVDT集成了110Ω終端電阻
  • 以SOIC和MSOP提供

參數(shù) 與其它產(chǎn)品相比?緩沖器、驅(qū)動(dòng)器/接收器和交叉點(diǎn)

?
Device Type
Protocols
No. of Tx
No. of Rx
Input Signal
Output Signal
Signaling Rate (Mbps)
ESD HBM (kV)
Function
Operating Temperature Range (C)
Package Group
Package Size: mm2:W x L (PKG)
Pin/Package
SN65LVDT101
Buffer ? ?
PECL ? ?
1 ? ?
1 ? ?
CML
LVDS
LVPECL ? ?
LVPECL ? ?
2000 ? ?
5 ? ?
Repeater/Translator ? ?
-40 to 85 ? ?
SOIC
VSSOP ? ?
8SOIC: 29 mm2: 6 x 4.9(SOIC)
8VSSOP: 15 mm2: 4.9 x 3(VSSOP) ? ?
8SOIC
8VSSOP ? ?

方框圖 (1)

技術(shù)文檔

數(shù)據(jù)手冊(cè)(1)
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