資料介紹
時(shí)鐘樹(shù)設(shè)計(jì)及其設(shè)計(jì)方式是引起系統(tǒng)芯片性能差異的主要原因。
低不確定性時(shí)鐘樹(shù)[LUCT]設(shè)計(jì)及算法與在系統(tǒng)芯片上實(shí)現(xiàn)的第一層時(shí)鐘樹(shù)的物理定義有關(guān),能夠讓設(shè)計(jì)人員克服傳統(tǒng)設(shè)計(jì)方法的所有低效率問(wèn)題。
從頂層的根時(shí)鐘網(wǎng)絡(luò)(通常是 PLL 輸出)到中層時(shí)鐘網(wǎng)絡(luò),LUCT 是一個(gè)高質(zhì)量的負(fù)載均衡的時(shí)鐘樹(shù),其目標(biāo)是將時(shí)鐘信號(hào)從中央鎖相環(huán) PLL 送到芯片的大部分區(qū)域,詳情參見(jiàn)參考文獻(xiàn)。該文獻(xiàn)詳細(xì)介紹了低不確定性時(shí)鐘樹(shù)[LUCT]方法和架構(gòu),概括了從規(guī)格定義到單元布局和時(shí)鐘合成的全部相關(guān)設(shè)計(jì)流程。
圖 1:在 ASIC 設(shè)計(jì)中優(yōu)化時(shí)鐘分配
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