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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設計_楊江濤

      基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設計_楊江濤

      2016-05-17 | pdf | 1317KB | 次下載 | 1積分

      資料介紹

      基于FPGA的高速數(shù)據(jù)采集系統(tǒng)設計，用ad芯片和sdram構成高速數(shù)據(jù)采集系統(tǒng)
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